參數(shù)資料
型號： CH7009A-T
廠商： Electronic Theatre Controls, Inc.
英文描述： Chrontel CH7009 DVI / TV Output Device
中文描述： 昆泰CH7009和DVI / TV輸出設(shè)備
文件頁數(shù)： 30/46頁
文件大?。?/td> 580K
代理商： CH7009A-T
CHRONTEL
TV PLL Control Register
CH7009A
TPC
09h
5
30
201-0000-035 Rev 1.1, 5/8/2000
Symbol:
Address:
Bits:
Bit 0 of register TPC controls the TV PLL loop filter capacitor. A recommended listing of PLLCAP setting versus
mode is listed in
Table 15
below.
Bit 1 of register TPC should be left at the default value.
Bits 4-2 of register TPC contain the MSB values for the TV PLL divider ratio’s. These controls are described in
detail in the PLLM and PLLN register descriptions.
Bit 5 of register TPC controls the input latch bias current. A value of TBD is recommended.
Bits 7-6 of register TPC control the memory sense amp reference level. The default value is recommended.
BIT:
7
6
5
4
3
2
1
0
SYMBOL:
TYPE:
DEFAULT:
MEM2
R/W
MEM1
R/W
IBI
R/W
N9
N8
M8
R/W
PLLCPI
R/W
PLLCAP
R/W
R/W
R/W
1
0
0
0
0
0
0
0
Table 15: PLLCAP setting vs Display Mode
Mode
PLLCAP
Value
Mode
PLLCAP
Value
0
1
2
3
4
5
6
7
8
9
1
1
0
0
1
1
0
1
0
1
0
1
0
1
1
1
0
0
0
0
20
21
22
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27
28
29
30
31
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33
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35
36
37
38
0
0
1
1
1
0
1
1
1
0
1
1
1
1
0
0
0
1
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相關(guān)PDF資料
PDF描述
CH7303 Chrontel CH7303 HDTV / DVI Encoder
CH8398A TRUE-COLOR CHRONDAC WITH 16-BIT INTERFACE
CHF1206CNT 20 W Power RF Chip Termination
CHF1206CNT500LY 20 W Power RF Chip Termination
CHF1206CNT500LZ 20 W Power RF Chip Termination
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參數(shù)描述
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