參數(shù)資料
型號： C8051F005DK
廠商： Silicon Laboratories Inc
文件頁數(shù)： 64/171頁
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描述： DEV KIT FOR F005/006/007
標準包裝： 1
類型： MCU
適用于相關(guān)產(chǎn)品： Silicon Laboratories C8051 F005/006/007
所含物品： 評估板，電源，USB 線纜，適配器和文檔
產(chǎn)品目錄頁面： 626 (CN2011-ZH PDF)
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336-1187-ND - IC 8051 MCU 32K FLASH 64TQFP
其它名稱： 336-1188
C8051F000/1/2/5/6/7
C8051F010/1/2/5/6/7
20.1.1. Edge-triggered Capture Mode
In this mode, a valid transition on the CEXn pin causes the PCA to capture the value of the PCA counter/timer and
load it into the corresponding module’s 16-bit capture/compare register (PCA0CPLn and PCA0CPHn). The CAPPn
and CAPNn bits in the PCA0CPMn register are used to select the type of transition that triggers the capture: low-to-
high transition (positive edge), high-to-low transition (negative edge), or either transition (positive or negative
edge). When a capture occurs, the Capture/Compare Flag (CCFn) in PCA0CN is set to logic 1 and an interrupt
request is generated if CCF interrupts are enabled. The CCFn bit is not automatically cleared by hardware when the
CPU vectors to the interrupt service routine, and must be cleared by software.
Figure 20.3. PCA Capture Mode Diagram
PCA0L
PCA0CPLn
PCA
Timebase
CEXn
Crossbar
Port I/O
PCA0H
Capture
PCA0CPHn
PCA0CN
C
F
C
R
C
F
0
C
F
2
C
F
1
C
F
4
C
F
3
0
PCA0CPMn
E
C
O
M
n
E
C
F
n
T
O
G
n
P
W
M
n
C
A
P
n
C
A
P
N
n
M
A
T
n
00 0 0
1
0
1
(t
o
CCF
n)
PCA Interrupt
Rev. 1.7
156
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PDF描述
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