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參數(shù)資料
| 型號： | C8051F005DK |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 23/171頁 |
| 文件大?。?/td> | 0K |
| 描述： | DEV KIT FOR F005/006/007 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | Silicon Laboratories C8051 F005/006/007 |
| 所含物品： | 評估板，電源，USB 線纜，適配器和文檔 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | C8051F007-GQR-ND - IC 8051 MCU 32K FLASH 32LQFP C8051F006-GQR-ND - IC 8051 MCU 32K FLASH 48TQFP C8051F005-GQR-ND - IC 8051 MCU 32K FLASH 64TQFP TAP 336-1190-ND - IC 8051 MCU 32K FLASH 32LQFP 336-1189-ND - IC 8051 MCU 32K FLASH 48TQFP 336-1187-ND - IC 8051 MCU 32K FLASH 64TQFP |
| 其它名稱： | 336-1188 |
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C8051F000/1/2/5/6/7
C8051F010/1/2/5/6/7
16.6.2. Clock Rate Register
Figure 16.5. SMB0CR: SMBus Clock Rate Register
R/W
Reset Value
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0xCF
Bits7-0: SMB0CR.[7:0]: SMBus Clock Rate Preset
The SMB0CR Clock Rate register controls the frequency of the serial clock SCL in master
mode. The 8-bit word stored in the SMB0CR Register preloads a dedicated 8-bit timer.
The timer counts up, and when it rolls over to 0x00, the SCL logic state toggles.
The SMB0CR setting should be bounded by the following equation, where SMB0CR is the
unsigned 8-bit value in register SMB0CR, and SYSCLK is the system clock frequency in
Hz:
SMB0CR < ((288 - 0.85 * SYSCLK) / 1.125E6)
The resulting SCL signal high and low times are given by the following equations:
T
= (256 – SMB0CR) / SYSCLK
LOW
(258 – SMB0CR) / SYSCLK + 625 ns
THIGH
Using the same value of SMB0CR from above, the Bus Free Timeout period is given in the
following equation:
T
10 * [(256 – SMB0CR) + 1] / SYSCLK
BFT
119
Rev. 1.7
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| LB2016T330K | INDUCTOR WOUND 33UH 85MA 0806 |
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| LM4040C25IDBZTG4 | IC VREF SHUNT PREC 2.5V SOT-23-3 |
| GEM12DTMH-S189 | CONN EDGECARD 24POS R/A .156 SLD |
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參數(shù)描述 |
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