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參數(shù)資料
| 型號： | C8051F005DK |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 34/171頁 |
| 文件大?。?/td> | 0K |
| 描述： | DEV KIT FOR F005/006/007 |
| 標準包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | Silicon Laboratories C8051 F005/006/007 |
| 所含物品： | 評估板，電源，USB 線纜，適配器和文檔 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | C8051F007-GQR-ND - IC 8051 MCU 32K FLASH 32LQFP C8051F006-GQR-ND - IC 8051 MCU 32K FLASH 48TQFP C8051F005-GQR-ND - IC 8051 MCU 32K FLASH 64TQFP TAP 336-1190-ND - IC 8051 MCU 32K FLASH 32LQFP 336-1189-ND - IC 8051 MCU 32K FLASH 48TQFP 336-1187-ND - IC 8051 MCU 32K FLASH 64TQFP |
| 其它名稱： | 336-1188 |
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C8051F000/1/2/5/6/7
C8051F010/1/2/5/6/7
Figure 17.7. SPI0CKR: SPI Clock Rate Register
R/W
Reset Value
SCR7
SCR6
SCR5
SCR4
SCR3
SCR2
SCR1
SCR0
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0x9D
Bits7-0: SCR7-SCR0: SPI Clock Rate
These bits determine the frequency of the SCK output when the SPI module is
configured for master mode operation. The SCK clock frequency is a divided down
version of the system clock, and is given in the following equations:
Figure 17.8. SPI0DAT: SPI Data Register
R/W
Reset Value
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0x9B
f
= 0.5 * f
/ (SPI0CKR + 1),
for 0
SPI0CKR 255,
SCK
SYSCLK
Bits7-0: SPI0DAT: SPI0 Transmit and Receive Data.
The SPI0DAT register is used to transmit and receive SPI data. Writing data to SPI0DAT
places the data immediately into the shift register and initiates a transfer when in Master
Mode. A read of SPI0DAT returns the contents of the receive buffer.
129
Rev. 1.7
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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