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參數(shù)資料
| 型號(hào)： | AMD-645 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Peripheral Bus Controller(外圍總線控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁數(shù)： | 79/242頁 |
| 文件大?。?/td> | 2929K |
| 代理商： | AMD-645 |
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Functional Operations
5-33
21095B/0—June 1997
AMD-645 Peripheral Bus Controller Data Sheet
Preliminary Information
decrements through a block boundary. The block size of an 8-
bit channel is 256 bytes, while that of a 16-bit channel is 512
bytes. The middle address portion is output by the 8237
megacells onto the internal data bus during state S1. The
internal middle address bit latches latch this value in. The
middle address bit latches are output on PCI address bits
AD[15:8] for 8-bit channels and AD[16:9] for 16-bit channels.
The lower address portion is generated directly by the 8237
megacells during DMA operations, and the lower address bits
are output on PCI address bits AD[7:0] for 8-bit channels and
AD[8:1] for 16-bit channels.
SBHE# is configured as an output during all DMA operations It
is driven as the inversion of AD0 during 8-bit cycles, and
forced low for all 16-bit DMA cycles. Table 5-9 shows the
mapping from the DMA subsystem signals to slot bus signals.
Table 5-10 shows the mapping of the AMD-645 peripheral bus
controller DMA subsystem signals to PCI address bus signals.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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