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參數(shù)資料
| 型號： | AMD-645 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Peripheral Bus Controller(外圍總線控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁數(shù)： | 197/242頁 |
| 文件大?。?/td> | 2929K |
| 代理商： | AMD-645 |
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Registers
7-71
21095B/0—June 1997
AMD-645 Peripheral Bus Controller Data Sheet
Preliminary Information
Bit 0
GPIO0_DIR
0=Pin 94 is GPIO0 input (default)
1=Pin 94 is GPIO0 output
Bit 7–5
Bit 4
Reserved
(always reads 0)
GPIO4_VAL
—Write output value for the GPIO4 pin if the port is available
(GPIO4_CFG = 1 in PCI configuration register Function 3, offset 40h). The
input state of the GPIO4 pin can be read from register EXTSMI_VAL bit
4.
GPIO3_VAL
—Write output value for the GPIO3 pin if the port is available
(GPIO3_CFG = 1 in PCI configuration register Function 3, offset 40h). The
input state of the GPIO3 pin can be read from register EXTSMI_VAL bit
3.
GPIO2_VAL
—Write output value for the GPIO2 (I2CD2) pin. The input state
of the GPIO2 pin can be read from register EXTSMI_VAL bit 2.
GPIO1_VAL
—Write output value for the GPIO1 (I2CD1) pin. The input state
of the GPIO1 pin can be read from register EXTSMI_VAL bit 1.
GPIO0_VAL
—Write output value for the GPIO0 pin. The input state of the
GPIO0 pin can be read from register EXTSMI_VAL bit 0.
Bit 3
Bit 2
Bit 1
Bit 0
Depending on the configuration, up to eight external SCI/SMI ports are
available as indicated below. The state of inputs EXTSMI7#–EXTSMI0#
can be read in this register.
EXTSMI7# Input Value
GPIO3_CFG = 0: EXTSMI7# on XD7 (pin 122)
GPIO3_CFG = 1: EXTSMI7# function not available
EXTSMI6# Input Value
GPIO3_CFG = 0: EXTSMI6# on XD6 (pin 121)
GPIO3_CFG = 1: EXTSMI6# function not available
EXTSMI5# Input Value
GPIO3_CFG = 0: EXTSMI5# on XD5 (pin 119)
GPIO3_CFG = 1: EXTSMI5 function not available
Bit 7
Bit 6
Bit 5
GPIO Port Output Value (GPIO_VAL)
Bit 7
Bit Name
Reset
0
Offset 42h
4
G4V
0
RW
6
5
3
2
1
Bit 0
G0V
0
Reserved
0
G3V
0
G2V
0
G1V
0
0
GPIO Port Input Value (EXTSMI_VAL)
Bit 7
Bit Name
E7IV
Reset
0
Offset 44h
4
E4IV
0
RO
6
5
3
2
1
Bit 0
E0IV
0
E6IV
0
E5IV
0
E3IV
0
E2IV
0
E1IV
0
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