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參數(shù)資料
| 型號(hào)： | AMD-645 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Peripheral Bus Controller(外圍總線控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁(yè)數(shù)： | 101/242頁(yè) |
| 文件大?。?/td> | 2929K |
| 代理商： | AMD-645 |
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Functional Operations
5-55
21095B/0—June 1997
AMD-645 Peripheral Bus Controller Data Sheet
Preliminary Information
the 16-bit IDE data bus shared between two channels. Note,
however, that a channel’s FIFO may be connected to the PCI
data bus while the other channel’s FIFO is connected to the
IDE data bus.
To initiate a bus master transfer between memory and an IDE
DMA slave device, the following steps are required:
1. Software prepares a physical region descriptor (PRD) table
in system memory. Each PRD is 8 bytes long and consists of
an address pointer to the starting address and the transfer
count of the memory buffer to be transferred. In any given
PRD table, two consecutive PRDs are offset by eight bytes
and are aligned on a 4-byte boundary.
2. Software provides the starting address of the PRD table by
loading the PRD table pointer register. The direction of the
data transfer is specified by setting the Read/Write Control
bit. Clear the Interrupt bit and the Error bit in the Status
register.
3. Software issues the appropriate DMA transfer command to
the disk device.
4. Engage the bus master function by writing a 1 to the Start
bit in the Bus Master IDE Command Register for the appro-
priate channel.
5. The controller transfers data to or from memory, respond-
ing to DMA requests from the IDE device.
6. At the end of the transfer the IDE device signals an inter-
rupt. This interrupt is generated as ISA interrupt 14 for the
primary channel or as ISA interrupt 15 for the secondary
channel.
7. In response to the interrupt, software resets the Start/Stop
bit in the Master Command register, then reads the control-
ler status and drive status to determine whether the trans-
fer completed successfully.
The physical memory transfer region is described by a physical
region descriptor (PRD). The data transfer proceeds until all
regions described by the PRDs in the table are transferred.
Each PRD entry is eight bytes long. The first four bytes specify
the byte address of a physical memory region. The next two
bytes specify the count of the region in bytes, with a 64-Kbyte
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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