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參數(shù)資料
型號(hào): ADUC841BSZ62-5
廠商: Analog Devices Inc
文件頁(yè)數(shù): 83/88頁(yè)
文件大?。?/td> 0K
描述: IC ADC/DAC 12BIT W/MCU 52-MQFP
產(chǎn)品培訓(xùn)模塊: Process Control
標(biāo)準(zhǔn)包裝: 1
系列: MicroConverter® ADuC8xx
核心處理器: 8052
芯體尺寸: 8-位
速度: 20MHz
連通性: I²C,SPI,UART/USART
外圍設(shè)備: DMA,PSM,PWM,溫度傳感器,WDT
輸入/輸出數(shù): 32
程序存儲(chǔ)器容量: 62KB(62K x 8)
程序存儲(chǔ)器類(lèi)型: 閃存
RAM 容量: 2.25K x 8
電壓 - 電源 (Vcc/Vdd): 4.75 V ~ 5.25 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x12b,D/A 2x12b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 52-QFP
包裝: 托盤(pán)
產(chǎn)品目錄頁(yè)面: 738 (CN2011-ZH PDF)
配用: EVAL-ADUC841QSZ-ND - KIT DEV FOR ADUC841 QUICK START
ADuC841/ADuC842/ADuC843
Rev. 0 | Page 84 of 88
Parameter
SPI SLAVE MODE TIMING (CPHA = 1)
Min
Typ
Max
Unit
tSS
SS to SCLOCK Edge
0
ns
tSL
SCLOCK Low Pulse Width
330
ns
tSH
SCLOCK High Pulse Width
330
ns
tDAV
Data Output Valid after SCLOCK Edge
50
ns
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
tDF
Data Output Fall Time
10
25
ns
tDR
Data Output Rise Time
10
25
ns
tSR
SCLOCK Rise Time
10
25
ns
tSF
SCLOCK Fall Time
10
25
ns
tSFS
SS High after SCLOCK Edge
0
ns
MISO
MOSI
SCLOCK
(CPOL = 1)
SCLOCK
(CPOL = 0)
SS
MSB
BITS 6–1
LSB
BITS 6–1
LSB IN
t
DHD
t
DSU
t
DR
t
DF
t
DAV
t
SH
t
SL
t
SR
t
SF
t
SFS
MSB IN
t
SS
03260-0-094
Figure 93. SPI Slave Mode Timing (CPHA = 1)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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