參數(shù)資料
型號(hào): AD9548BCPZ-REEL7
廠商: Analog Devices Inc
文件頁(yè)數(shù): 93/112頁(yè)
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描述: IC CLOCK GEN/SYNCHRONIZR 88LFCSP
產(chǎn)品變化通告: AD9548 Mask Change 20/Oct/2010
標(biāo)準(zhǔn)包裝: 400
類型: 時(shí)鐘/頻率發(fā)生器,同步器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,LVPECL
輸出: CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 是/是
頻率 - 最大: 750kHz
電源電壓: 1.71 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 88-VFQFN 裸露焊盤,CSP
供應(yīng)商設(shè)備封裝: 88-LFCSP-VQ(12x12)
包裝: 帶卷 (TR)
Data Sheet
AD9548
Rev. E | Page 81 of 112
Table 74. Q3 Divider1
Address
Bits
Bit Name
Description
0x0414
[7:0]
Q3
Q3 divider, Bits[7:0]
0x0415
[7:0]
Q3 divider, Bits[15:8]
0x0416
[7:0]
Q3 divider, Bits[23:16]
0x0417
[7:6]
Unused
[5:0]
Q3
Q3 divider, Bits[29:24]
1
The default value is 0 (or divide by 1).
REFERENCE INPUT CONFIGURATION (REGISTER 0x0500 TO REGISTER 0x0507)
Table 75. Reference Power-Down
When all bits are set, the reference receiver section enters a deep sleep mode.
Address
Bits
Bit Name
Description
0x0500
[7]
Ref DD power-down
REF DD input receiver power-down
0 (default) = normal operation
1 = power-down
[6]
Ref D power-down
REF D input receiver power-down
0 (default) = normal operation
1 = power-down
[5]
Ref CC power-down
REF CC input receiver power-down
0 (default) = normal operation
1 = power-down
[4]
Ref C power-down
REF C input receiver power-down
0 (default) = normal operation
1 = power-down
[3]
Ref BB power-down
REF BB input receiver power-down
0 (default) = normal operation
1 = power-down
[2]
Ref B power-down
REF B input receiver power-down
0 (default) = normal operation
1 = power-down
[1]
Ref AA power-down
REF AA input receiver power-down
0 (default) = normal operation
1 = power-down
[0]
Ref A power-down
REF A input receiver power-down
0 (default) = normal operation
1 = power-down
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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