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參數(shù)資料
型號: AD9548BCPZ-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 63/112頁
文件大?。?/td> 0K
描述: IC CLOCK GEN/SYNCHRONIZR 88LFCSP
產(chǎn)品變化通告: AD9548 Mask Change 20/Oct/2010
標準包裝: 400
類型: 時鐘/頻率發(fā)生器,同步器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,LVPECL
輸出: CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 是/是
頻率 - 最大: 750kHz
電源電壓: 1.71 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 88-VFQFN 裸露焊盤,CSP
供應(yīng)商設(shè)備封裝: 88-LFCSP-VQ(12x12)
包裝: 帶卷 (TR)
AD9548
Data Sheet
Rev. E | Page 54 of 112
tS
DON'T CARE
W1
W0
A12
A11
A10
A9
A8A7
A6A5D4
D3D2
D1
D0
HIGH-IMEPDANCE
R/W
tDS
tDH
tHIGH
tLOW
tCLK
tC
CS
SCLK
SDIO
08
02
2-
15
3
Figure 56. Serial Control Port Read—MSB First, 16-Bit Instruction, One Byte of Data
tS
DON'T CARE
W1
W0
A12
A11
A10
A9A8A7A6A5
D4
D3D2D1D0
DON'T CARE
R/W
tDS
tDH
tHI
tLO
tCLK
tC
CS
SCLK
SDIO
0
80
22
-0
31
Figure 57. Serial Control Port Write—MSB First, 16-Bit Instruction, Timing Measurements
DATA BIT N – 1
DATA BIT N
CS
SCLK
SDIO
SDO
tDV
08
022
-03
2
Figure 58. Timing Diagram for Serial Control Port Register Read
CS
SCLK DON'T CARE
DON'T CARE
16-BIT INSTRUCTION HEADER
REGISTER (N) DATA
REGISTER (N + 1) DATA
SDIO
DON'T CARE
A0 A1
A2
A3
A4
A5 A6
A7
A8
A9 A10 A11 A12
D1
D0
R/W
W1
W0
D2
D3
D4
D5 D6
D7
D0
D1
D2
D3
D4
D5
D6
D7
0
80
22
-0
33
Figure 59. Serial Control Port Write—LSB First, 16-Bit Instruction, Two Bytes of Data
CS
SCLK
SDIO
tHI
tLO
tCLK
tS
tDS
tDH
tC
BIT N
BIT N + 1
08
02
2-
0
34
Figure 60. Serial Control Port Timing—Write
相關(guān)PDF資料
PDF描述
AD9549ABCPZ-REEL7 IC CLOCK GEN/SYNCHRONIZR 64LFCSP
AD9550BCPZ-REEL7 IC INTEGER-N TRANSLATOR 32-LFCSP
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參數(shù)描述
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