參數(shù)資料
型號(hào)： AD9547BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 2/104頁
文件大?。?/td> 0K
描述： IC CLOCK GEN/SYNCHRONIZR 64LFCSP
產(chǎn)品變化通告： AD9547 Mask Change 20/Oct/2010
標(biāo)準(zhǔn)包裝： 750
類型： 時(shí)鐘/頻率發(fā)生器，同步器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 750kHz
電源電壓： 1.71 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
AD9547
Data Sheet
Rev. E | Page 10 of 104
TIME DURATION OF DIGITAL FUNCTIONS
Table 13.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
EEPROM-TO-REGISTER DOWNLOAD TIME
25
ms
Using default EEPROM storage sequence
(see Register 0x0E10 to Register 0x0E3F)
REGISTER-TO-EEPROM UPLOAD TIME
200
ms
Using default EEPROM storage sequence
(see Register 0x0E10 to Register 0x0E3F
MINIMUM POWER-DOWN EXIT TIME
10.5
s
Dependent on loop filter bandwidth
MAXIMUMTIMEFROM ASSERTION OFTHERESETPIN
TOTHE M0 TO M7 PINSENTERING HIGH
IMPEDANCESTATE
45
ns
DIGITAL PLL
Table 14.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
PHASE FREQUENCY DETECTOR (PFD) INPUT
FREQUENCY RANGE
0.001
10
MHz
Maximum fPFD = fS/1001, 2
LOOP BANDWIDTH
0.001
1 × 105
Hz
Programmable designparameter;
maximum fLOOP = fREF/(20R)3
PHASE MARGIN
30
89
Degrees
Programmable designparameter
REFERENCE INPUT(R) DIVISION FACTOR
1
230
1, 2, …1,073,741,824
INTEGER FEEDBACK (S) DIVISION FACTOR
8
220
8, 9, …1,048,576
FRACTIONAL FEEDBACK DIVIDE RATIO
0
0.999
Maximum value = 1022/1023
1
fPFD is the frequency at the input to the phase-frequency detector.
2
fS is the sample rate of the output DAC.
3
fREF is the frequency of the active reference; R is the frequency division factor determined by the R divider.
DIGITAL PLL LOCK DETECTION
Table 15.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
PHASE LOCK DETECTOR
Threshold ProgrammingRange
0.001
65.5
ns
Threshold Resolution
1
ps
FREQUENCY LOCK DETECTOR
Threshold ProgrammingRange
0.001
16,700
ns
Reference-to-feedback perioddifference
Threshold Resolution
1
ps
HOLDOVER SPECIFICATIONS
Table 16.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
FREQUENCY ACCURACY
<0.01
ppb
Excludes frequency drift of SYSCLK source;
excludes frequency drift of input reference
prior to enteringholdover
相關(guān)PDF資料
PDF描述
AD9548BCPZ-REEL7 IC CLOCK GEN/SYNCHRONIZR 88LFCSP
AD9549ABCPZ-REEL7 IC CLOCK GEN/SYNCHRONIZR 64LFCSP
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AD9551BCPZ IC CLOCK GEN MULTISERV 40-LFCSP
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參數(shù)描述
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AD9548BCPZ-REEL7 功能描述:IC CLOCK GEN/SYNCHRONIZR 88LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時(shí)鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時(shí)鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件
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