參數(shù)資料
型號(hào)： AD9148BBCZRL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 19/72頁(yè)
文件大小： 0K
描述： IC DAC 16BIT QD 1GSPS 196CSPBGA
標(biāo)準(zhǔn)包裝： 1,500
系列： TxDAC+®
設(shè)置時(shí)間： 20ns
位數(shù)： 16
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 4
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 2.22W
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 196-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 196-CSPBGA（12x12）
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 8 電流，單極
采樣率（每秒）： 1G
AD9148
Data Sheet
Rev. B | Page 26 of 72
Addr
Register
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Default
0x54
FTW (LSB)
FTW[7:0]
0x00
0x55
FTW
FTW [15:8]
0x00
0x56
FTW
FTW[23:16]
0x00
0x57
FTW (MSB)
FTW[31:24]
0x00
0x58
Phase offset
(MSB)
NCO Phase Offset[15:8]
0x00
0x59
Phase offset
(LSB)
NCO Phase Offset[7:0]
0x00
0x5A
DDS/mod
control
Bypass
DDS/MOD
Frame NCO
reset ack
Frame NCO
reset request
FTW
update ack
FTW
update
request
Sideband
select
0x80
0x5C
Die Temp
Control 0
Latch
temp
data
Temp sensor
power-down
0x01
0x5D
Die Temp
Control 1
0
1
0
1
0
0x20
0x5E
Die temp LSB
Die Temp[7:0]
0x5F
Die temp MSB
Die Temp[15:8]
0x72
DCI delay
DCI Delay[1:0]
0x00
1
Register 0x20 to Register 0x3F and Register 0x41 to Register 0x51 configure DAC 1 (I) and DAC 2 (Q) data paths with DAC SPI select = 0 (Register 0x00[4]). Register 0x20
to Register 0x3F and Register 0x41 to Register 0x51 configure DAC 3 (I) and DAC 4 (Q) data paths with DAC SPI select = 1 (Register 0x00[4]).
SPI REGISTER DESCRIPTIONS
Table 13. Register Descriptions
Register Name
Addr
(Hex)
Bit
Name
Function
Default
Comm
00
7
SDIO
SDIO operation.
0
0 = SDIO operates as an input only.
1 = SDIO operates as bidirectional input/output.
6
LSB/MSB first
SPI communication LSB first (default is MSB first).
0
0 = MSB first.
1 = LSB first.
5
Software Reset
Software reset.
0
Reset is asserted when this bit transitions from 0 to 1.
4
DAC SPI select
Selects which DAC data path Register 0x20 to Register 0x3F
and Register 0x41 to Register 0x51 configure.
0
0 = DAC 1 (I path) and DAC 2 (Q path) are configured.
0
1 = DAC 3 (I path) and DAC 4 (Q path) are configured.
Power Control
01
7
Power-Down
DAC Set 1
Power down DAC 1 and power down DAC 2.
0
6
Power-Down
DAC Set 2
Power down DAC 3 and power down DAC 4.
0
5
Power-down
data receiver
Power down the input data receiver.
0
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PDF描述
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參數(shù)描述
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