參數(shù)資料
型號: AC164336
廠商: Microchip Technology
文件頁數(shù): 89/285頁
文件大?。?/td> 0K
描述: MODULE SOCKET FOR PM3 28/44QFN
標(biāo)準包裝: 1
模塊/板類型: QFN 插口模塊
適用于相關(guān)產(chǎn)品: MPLAB? PM3
產(chǎn)品目錄頁面: 658 (CN2011-ZH PDF)
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2006 Microchip Technology Inc.
Preliminary
DS70178C-page 177
dsPIC30F1010/202X
REGISTER 16-6:
A/D CONVERT PAIR CONTROL REGISTER #1 (ADCPC1)
R/W-0
IRQEN3
PEND3
SWTRG3
TRGSRC3<4:0>
bit 15
bit 8
R/W-0
IRQEN2
PEND2
SWTRG2
TRGSRC2<4:0>
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15
IRQEN3: Interrupt Request Enable 3 bit
1
= Enable IRQ generation when requested conversion of channels AN7 and AN6 is completed.
0
= IRQ is not generated
bit 14
PEND3: Pending Conversion Status 3 bit
1
= Conversion of channels AN7 and AN6 is pending. Set when selected trigger is asserted.
0
= Conversion is complete
bit 13
SWTRG3: Software Trigger 3 bit
1
= Start conversion of AN7 and AN6 (if selected by TRGSRC bits). If other conversions are in
progress, then conversion will be performed when the conversion resources are available. This bit will
be reset when the PEND bit is set.
bit 12-8
TRGSRC3<4:0>: Trigger 3 Source Selection bits
Selects trigger source for conversion of analog channels A7 and A6.
00000
= No conversion enabled
00001
= Individual software trigger selected
00010
= Global software trigger selected
00011
= PWM Special Event Trigger selected
00100
= PWM generator #1 trigger selected
00101
= PWM generator #2 trigger selected
00110
= PWM generator #3 trigger selected
00111
= PWM generator #4 trigger selected
01100
= Timer #1 period match
01101
= Timer #2 period match
01110
= PWM GEN #1 current-limit ADC trigger
01111
= PWM GEN #2 current-limit ADC trigger
10000
= PWM GEN #3 current-limit ADC trigger
10001
= PWM GEN #4 current-limit ADC trigger
10110
= PWM GEN #1 fault ADC trigger
10111
= PWM GEN #2 fault ADC trigger
11000
= PWM GEN #3 fault ADC trigger
11001
= PWM GEN #4 fault ADC trigger
bit 7
IRQEN2: Interrupt Request Enable 2 bit
1
= Enable IRQ generation when requested conversion of channels AN5 and AN4 is completed
0
= IRQ is not generated
bit 6
PEND2: Pending Conversion Status 2 bit
1
= Conversion of channels AN5 and AN4 is pending. Set when selected trigger is asserted
0
= Conversion is complete
bit 5
SWTRG2: Software Trigger 2 bit
1
= Start conversion of AN5 and AN4 (if selected by TRGSRC bits). If other conversions are in
progress, then conversion will be performed when the conversion resources are available. This bit will
be reset when the PEND bit is set
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PDF描述
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