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參數(shù)資料
| 型號(hào)： | AC164336 |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 44/285頁 |
| 文件大?。?/td> | 0K |
| 描述： | MODULE SOCKET FOR PM3 28/44QFN |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 模塊/板類型： | QFN 插口模塊 |
| 適用于相關(guān)產(chǎn)品： | MPLAB? PM3 |
| 產(chǎn)品目錄頁面： | 658 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | PIC24HJ64GP502T-I/MM-ND - IC DSPIC MCU/DSP 64K 28-QFN DSPIC33FJ64GP802T-I/MM-ND - IC DSPIC MCU/DSP 64K 28-QFN PIC24HJ64GP502-I/MM-ND - IC PIC MCU FLASH 64K 28-QFN PIC24HJ64GP502-E/MM-ND - IC PIC MCU FLASH 64K 28-QFN PIC24FJ64GA004-E/ML-ND - IC PIC MCU FLASH 64K 44-QFN PIC24FJ64GA002-E/ML-ND - IC PIC MCU FLASH 64K 28-QFN PIC24FJ48GA004-E/ML-ND - IC PIC MCU FLASH 48K 44-QFN PIC24FJ48GA002-E/ML-ND - IC PIC MCU FLASH 48K 28-QFN PIC24FJ32GA004-E/ML-ND - IC PIC MCU FLASH 32K 44-QFN PIC24FJ32GA002-E/ML-ND - IC PIC MCU FLASH 32K 28-QFN 更多... |
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dsPIC30F1010/202X
DS70178C-page 136
Preliminary
2006 Microchip Technology Inc.
12.31.2
OVERRIDE SYNCHRONIZATION
If the OSYNC bit in the IOCONx register is set, the out-
put overrides performed via the OVRENH,L and the
OVDDAT<1:0> bits are synchronized to the PWM time
base.
Synchronous output overrides occur when the
time base is zero.
If PTEN = 0, meaning the timer is not running, writes to
IOCON take effect on the next TCY boundary.
12.32 Functional Exceptions
12.32.1
POWER RESET CONDITIONS
All registers associated with the PWM module are reset
to the states given in Table 12-4 upon a Power-on
Reset. On a device reset, the PWM output pins are
tri-stated.
12.32.2
SLEEP MODE
The selected Fault input pin has the ability to wake the
CPU from Sleep mode. The PWM module should gen-
erate an asynchronous interrupt if any of the selected
Fault pins is driven low while in Sleep.
It is recommended that the user disable the PWM out-
puts prior to entering Sleep mode. If the PWM module
is controlling a power conversion application, the action
of putting the device into Sleep will cause any control
loops to be disabled, and most applications will likely
experience issues unless they are explicitly designed
to operate in an Open-Loop mode.
12.32.3
CPU IDLE MODE
The dsPIC30F202X module has a PTSIDL control bit in
the PTCON register. This bit determines if the PWM
module continues to operate or stops when the device
enters Idle mode. Stopped Idle mode functions like
Sleep mode, and Fault pins are asynchronously active.
PTSIDL = 1 (Stop module when in Idle mode)
PTSIDL = 0 (Don't stop module when in Idle
mode)
It is recommended that the user disable the PWM out-
puts prior to entering Idle mode. If the PWM module is
controlling a power-conversion application, the action
of putting the device into Idle will cause any control
loops to be disabled, and most applications will likely
experience issues unless they are explicitly designed
to operate in an Open-Loop mode.
12.33 Register Bit Alignment
Table 12-4 on page 142 shows the registers for the PS
PWM module. All time-based data for the module is
always bit-aligned with respect to time. For example: bit
3 in the period register, the duty cycle registers, the
dead-time registers, the trigger registers and the phase
registers always represents a value of 8.4 nsec,
assuming 30 MIPS operation. Unused portions of reg-
isters always read as zeros.
The use of data alignment makes it easier to write soft-
ware because it eliminates the need to shift time values
to fit into registers. It also eases the computation and
understanding of time allotment within a PWM cycle.
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