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參數(shù)資料
| 型號： | 30044-23 |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Low Power Integrated x86-Compatible with MMX Support 32-Bit Geode GXm Processor(低功耗集成兼容X86帶有MMX的32位 Geode GXm技術(shù)處理器) |
| 中文描述： | 32-BIT, 200 MHz, MICROPROCESSOR, CPGA320 |
| 封裝： | SPGA-320 |
| 文件頁數(shù)： | 61/244頁 |
| 文件大?。?/td> | 4496K |
| 代理商： | 30044-23 |
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Revision 3.1
61
www.national.com
Processor Programming (
Continued
)
G
3.5
The mapping of address space into a sequence of mem-
ory locations (often cached) is performed by the offset,
segment and paging mechanisms.
OFFSET, SEGMENT, AND PAGING MECHANISMS
In general, the offset, segment and paging mechanisms
work in tandem as shown below:
instruction offset
offset address
linear address
paging mechanism
physical page.
offset mechanism
segment mechanism
offset address
linear address
As will be explained, the actual operations depend on sev-
eral factors such as the current operating mode and if
paging is enabled. Note: the paging mechanism uses part
of the linear address as an offset on the physical page.
3.6
In all operating modes, the offset mechanism computes
an offset (effective) address by adding together up to
three values: a base, an index and a displacement. The
base, if present, is the value in one of eight general regis-
ters at the time of the execution of the instruction. The
index, like the base, is a value that is contained in one of
the general registers (except the ESP register) when the
instruction is executed. The index differs from the base in
that the index is first multiplied by a scale factor of 1, 2, 4
or 8 before the summation is made. The third component
added to the memory address calculation is the displace-
ment that is a value supplied as part of the instruction.
Figure 3-3 illustrates the calculation of the offset address.
OFFSET MECHANISM
Nine valid combinations of the base, index, scale factor
and displacement can be used with the CPU instruction
set. These combinations are listed in Table 3-19 on page
61. The base and index both refer to contents of a register
as indicated by [Base] and [Index].
In real mode operation, the CPU only addresses the low-
est 1 MB of memory and the offset contains 16-bits. In
protective mode the offset contains 32 bits. Initialization
and transition to protective mode is described in Section
3.13.4 “Initialization and Transition to Protected Mode” on
page 87.
Figure 3-3. Offset Address Calculation
Table 3-19. Memory Addressing Modes
Index
Base
Displacement
Scaling
x1, x2, x4, x8
Offset Address
(Effective Address)
+
Addressing Mode
Base
Index
Scale
Factor
(SF)
Displacement
(DP)
Offset Address (OA)
Calculation
Direct
x
OA = DP
Register Indirect
x
OA = [BASE]
Based
x
x
OA = [BASE] + DP
Index
x
x
OA = [INDEX] + DP
Scaled Index
x
x
x
OA = ([INDEX] * SF) + DP
Based Index
x
x
OA = [BASE] + [INDEX]
Based Scaled Index
x
x
x
OA = [BASE] + ([INDEX] * SF)
Based Index with
Displacement
x
x
x
OA = [BASE] + [INDEX] + DP
Based Scaled Index with
Displacement
x
x
x
x
OA = [BASE] + ([INDEX] * SF) + DP
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PDF描述 |
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