參數(shù)資料
型號(hào)： ZL50418GKC
廠商： Zarlink Semiconductor Inc.
英文描述： Managed 16-Port 10/100 M + 2-Port 1 G Ethernet Switch
中文描述： 管理16端口10/100平方米端口1個(gè)G以太網(wǎng)交換機(jī)
文件頁(yè)數(shù)： 81/163頁(yè)
文件大?。?/td> 2122K
代理商： ZL50418GKC
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ZL50418
Data Sheet
81
Zarlink Semiconductor Inc.
14.7.15 INTP_MASK7 – Interrupt Mask for MAC Port 14,15
CPU Address:h317
Accessed by CPU, serial interface (R/W)
14.7.16 INTP_MASK12 – Interrupt Mask for MAC Port G1,G2
CPU Address:h31C
Accessed by CPU, serial interface (R/W)
14.7.17 RQS – Receive Queue Select CPU Address:h323
Accessed by CPU, serial interface (R/W)
Select which receive queue is used.
Bit [0]: Select Queue 0. If set to one, this queue may be scheduled to CPU port. If set to zero, this queue will be
blocked. If multiple queues are selected, a strict priority will be applied. Q3> Q2> Q1> Q0. Same applies to bits
[3:1]. See QoS Application Note for more information.
Bit [1]: Select Queue 1
Bit [2]: Select Queue 2
Bit [3]: Select Queue 3
Note:
Strip priority applies between different selected queues (Q3>Q2>Q1>Q0)
Bit [4]: Enable flush Queue 0
Bit [5]: Enable flush Queue 1
Bit [6]: Enable flush Queue 2
Bit [7]: Enable flush Queue 3
When flush (drop frames) is enable, it starts when queue is too long or entry is too old. A queue is too long when it
reaches WRED thresholds. Queue 0 is not subject to early drop. Packets in queue 0 are dropped only when the
queue is too old. An entry is too old when it is older than the time programmed in the register TX_AGE [5:0]. CPU
can dynamically program this register reading register RQSS [7:4].
14.7.18 RQSS – Receive Queue Status
CPU Address:h324
Accessed by CPU, serial interface (RO)
7
6
5
4
3
2
1
0
FQ3
FQ2
FQ1
FQ0
SQ3
SQ2
SQ1
SQ0
7
5
4
3
0
LQ3
LQ2
LQ1
LQ0
NeQ3
NeQ2
NeQ1
NeQ0
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PDF描述
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