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參數(shù)資料
| 型號(hào)： | XCV812E-6FG900C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 3/118頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1.8V C-TEMP 900-FBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex®-E EM |
| LAB/CLB數(shù)： | 4704 |
| 邏輯元件/單元數(shù)： | 21168 |
| RAM 位總計(jì)： | 1146880 |
| 輸入/輸出數(shù)： | 556 |
| 門數(shù)： | 254016 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 900-BBGA |
| 供應(yīng)商設(shè)備封裝： | 900-FBGA |
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Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays
Module 4 of 4
DS025-4 (v3.0) March 21, 2014
24
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
50
2
F23
G23
√
-
51
2
H23
J20
√
VREF
52
2
G24
H22
√
-
53
2
J21
G25
2
-
54
2
G26
J22
1
-
55
2
H24
J23
√
-
56
2
J24
K20
√
VREF
57
2
K22
K21
√
D2
58
2
H25
K23
√
-
592L20
J26
2
-
60
2
K25
L22
1
-
612L21
L23
1
-
62
2
M20
L24
1
-
63
2
M23
M22
√
D3
642L26
M21
√
-
65
2
N19
M24
2
-
66
2
M26
N20
1
VREF
67
2
N24
N21
√
-
68
2
N23
N22
√
-
69
3
P21
P23
√
-
70
3
P22
R25
1
VREF
71
3
P19
P20
2
-
72
3
R21
R22
√
-
73
3
R24
R23
√
VREF
74
3
T24
R20
1
-
75
3
T22
U24
1
-
76
3
T23
U25
1
-
77
3
T21
U20
2
-
78
3
U22
V26
√
-
79
3
T20
U23
√
D5
80
3
V24
U21
√
VREF
81
3
V23
W24
√
-
82
3
V22
W26
NA
-
83
3
Y25
V21
NA
-
Table 4:
FG676 Fine-Pitch BGA Differential Pin Pair
Summary — XCV405E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
84
3
V20
AA26
√
-
85
3
Y24
W23
√
VREF
86
3
AA24
Y23
NA
-
87
3
AB26
W21
NA
-
88
3
Y22
W22
NA
VREF
89
3
AA23
AB24
NA
-
90
3
W20
AC24
√
-
91
3
AB23
Y21
√
INIT
92
4
AC22
AD26
√
-
93
4
AD23
AA20
NA1
-
94
4
Y19
AC21
√
-
95
4
AD22
AB20
√
VREF
96
4
AE22
Y18
NA
-
97
4
AF22
AA19
NA
-
98
4
AD21
AB19
√
VREF
99
4
AC20
AA18
√
-
100
4
AC19
AD20
NA
-
101
4
AF20
AB18
NA
-
102
4
AD19
Y17
NA
-
103
4
AE19
AD18
NA
VREF
104
4
AF19
AA17
√
-
105
4
AC17
AB17
NA
-
106
4
Y16
AE17
√
-
107
4
AF17
AA16
√
-
108
4
AD17
AB16
NA
-
109
4
AC16
AD16
√
-
110
4
AC15
Y15
√
VREF
111
4
AD15
AA15
√
-
112
4
W14
AB15
NA
-
113
4
AF15
Y14
NA
VREF
114
4
AD14
AB14
NA
-
115
5
AC14
AF13
NA
IO_LVDS_DLL
116
5
AA13
AF12
NA
VREF
117
5
AC13
W13
NA
-
Table 4:
FG676 Fine-Pitch BGA Differential Pin Pair
Summary — XCV405E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RCB106DHAR-S621 | EDGECARD 212POS DIP R/A .050 SLD |
| XC6VLX240T-1FFG1759C | IC FPGA VIRTEX 6 241K 1759FFGBGA |
| ACC65DRXN | CONN EDGECARD 130PS .100 DIP SLD |
| RMC65DRYI-S734 | CONN EDGECARD 130PS DIP .100 SLD |
| XC4VSX55-10FF1148I | IC FPGA VIRTEX-4SX 1148FFBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCV812E-6FG900I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG404C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG404I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG556C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG556I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
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