參數(shù)資料
型號: XCV405E-7FG676I
廠商: Xilinx Inc
文件頁數(shù): 4/118頁
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描述: IC FPGA 1.8V 676-BGA
產(chǎn)品變化通告: FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝: 1
系列: Virtex®-E EM
LAB/CLB數(shù): 2400
邏輯元件/單元數(shù): 10800
RAM 位總計: 573440
輸入/輸出數(shù): 404
門數(shù): 129600
電源電壓: 1.71 V ~ 1.89 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 100°C
封裝/外殼: 676-BGA
供應(yīng)商設(shè)備封裝: 676-FBGA(27x27)
Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays
DS025-4 (v3.0) March 21, 2014
Module 4 of 4
25
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
118
5
AA12
AD12
-
119
5
AC12
AB12
VREF
120
5
AD11
Y12
-
121
5
AB11
AD10
NA
-
122
5
AC11
AE10
-
123
5
AC10
AA11
-
124
5
Y11
AD9
NA
-
125
5
AB10
AF9
-
126
5
AD8
AA10
VREF
127
5
AE8
Y10
-
128
5
AC9
AF8
NA
-
129
5
AF7
AB9
NA
-
130
5
AA9
AF6
-
131
5
AC8
AC7
VREF
132
5
AD6
Y9
-
133
5
AE5
AA8
-
134
5
AC6
AB8
VREF
135
5
AD5
AA7
-
136
5
AF4
AC5
NA
-
137
6
AC3
AA5
-
138
6
AB4
AC2
-
139
6
AA4
W6
NA
-
140
6
Y5
AB3
NA
VREF
141
6
V7
AB2
NA
-
142
6
Y4
AB1
-
143
6
W5
V5
VREF
144
6
V6
AA1
-
145
6
Y3
W4
NA
-
146
6
U7
Y1
NA
-
147
6
V4
W1
-
148
6
U6
W2
VREF
149
6
T5
V3
-
150
6
U4
U5
-
151
6
U3
T7
NA
-
Table 4:
FG676 Fine-Pitch BGA Differential Pin Pair
Summary — XCV405E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
152
6
T6
U2
NA
-
153
6
T4
U1
NA
-
154
6
T3
R7
NA
-
155
6
R6
R4
VREF
156
6
R5
R3
-
157
6
P7
P8
NA
-
158
6
P6
R1
NA
VREF
159
6
P4
P5
-
160
7
N8
N5
-
161
7
N3
N6
-
162
7
M2
N4
NA
VREF
163
7
M7
N7
NA
-
164
7
M3
M6
-
165
7
M5
M4
VREF
166
7
L7
L3
NA
-
167
7
K2
L6
NA
-
168
7
K1
L4
NA
-
169
7
L5
K3
NA
-
170
7
J3
K5
-
171
7
J4
K4
-
172
7
K6
H3
VREF
173
7
G3
K7
-
174
7
H1
J5
NA
-
175
7
J6
G2
NA
-
176
7
F1
J7
-
177
7
G4
H4
VREF
178
7
H5
F3
NA
-
179
7
H6
E2
NA
-
180
7
F4
G5
NA
VREF
181
7
G6
H7
NA
-
182
7
E4
E3
-
Table 4:
FG676 Fine-Pitch BGA Differential Pin Pair
Summary — XCV405E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
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