參數(shù)資料
型號(hào)： XC3S500E-4FG320I
廠商： Xilinx Inc
文件頁數(shù)： 116/227頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3E 320FBGA
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3E
LAB/CLB數(shù)： 1164
邏輯元件/單元數(shù)： 10476
RAM 位總計(jì)： 368640
輸入/輸出數(shù)： 232
門數(shù)： 500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
202
2
IO_L20P_2
T12
I/O
2
N.C. (
)
IO_L21N_2
P12
500E: N.C.
1200E: I/O
1600E: I/O
2
N.C. (
)
IO_L21P_2
N12
500E: N.C.
1200E: I/O
1600E: I/O
2
IO_L22N_2/A22
R13
DUAL
2
IO_L22P_2/A23
P13
DUAL
2
IO_L24N_2/A20
R14
DUAL
2
IO_L24P_2/A21
T14
DUAL
2
IO_L25N_2/VS1/A18
U15
DUAL
2
IO_L25P_2/VS2/A19
V15
DUAL
2
IO_L26N_2/CCLK
U16
DUAL
2
IO_L26P_2/VS0/A17
T16
DUAL
2
IP
V2
INPUT
2
IP
V16
INPUT
2
IP_L02N_2
V3
INPUT
2
IP_L02P_2
V4
INPUT
2
IP_L08N_2
R7
INPUT
2
IP_L08P_2
T7
INPUT
2
IP_L11N_2/VREF_2
V8
VREF
2
IP_L11P_2
U8
INPUT
2
IP_L14N_2/M2/GCLK1
T10
DUAL/GCLK
2
IP_L14P_2/RDWR_B/
GCLK0
IP_L14P_2/RDWR_B/
GCLK0
IP_L14P_2/RDWR_B/
GCLK0
U10
DUAL/GCLK
2
IP_L17N_2
U11
INPUT
2
IP_L17P_2
T11
INPUT
2
IP_L23N_2
U14
INPUT
2
IP_L23P_2
V14
INPUT
2
VCCO_2
M8
VCCO
2
VCCO_2
M11
VCCO
2
VCCO_2
T6
VCCO
2
VCCO_2
T13
VCCO
2
VCCO_2
V10
VCCO
3
N.C. (
)
IO
D4
500E: N.C.
1200E: I/O
1600E: I/O
3
IO_L01N_3
C2
I/O
3
IO_L01P_3
C1
I/O
3
IO_L02N_3/VREF_3
D2
VREF
3
IO_L02P_3
D1
I/O
3
IO_L03N_3
E1
I/O
3
IO_L03P_3
E2
I/O
Table 148: FG320 Package Pinout (Cont’d)
Bank
XC3S500E Pin Name
XC3S1200E Pin Name
XC3S1600E Pin Name
FG320
Ball
Type
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PDF描述
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XC3S500E-4FT256I4003 制造商:Xilinx 功能描述:
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