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參數(shù)資料
| 型號： | XC3S1000-4CPG132C |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Spartan-3 FPGA Family: Complete Data Sheet |
| 中文描述： | FPGA, 192 CLBS, 50000 GATES, PBGA132 |
| 封裝： | LEAD FREE, CSP-132 |
| 文件頁數(shù)： | 37/198頁 |
| 文件大?。?/td> | 1605K |
| 代理商： | XC3S1000-4CPG132C |
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Spartan-3 FPGA Family: Functional Description
30
www.xilinx.com
DS099-2 (v1.3) August 24, 2004
Preliminary Product Specification
40
R
width of the die. In turn, the horizontal spine branches
out into a subsidiary clock interconnect that accesses
the CLBs.
The clock input of either DCM on the same side of the
die — top or bottom — as the BUFGMUX element in
use.
2.
A Global clock input is placed in a design using either a
BUFGMUX element or the BUFG (Global Clock Buffer) ele-
ment. For the purpose of minimizing the dynamic power dis-
sipation of the clock network, the Xilinx development
software automatically disables all clock line segments that
a design does not use.
Figure 18:
Spartan-3 Clock Network (Top View)
4
4
4
4
4
4
4
8
8
4
4
8
8
Horizontal Spine
T
B
4
DCM
DCM
DCM
DCM
Array Dependent
Array Dependent
DS099-2_18_070203
4 BUFGMUX
GCLK2
GCLK3
GCLK0
GCLK1
4 BUFGMUX
GCLK6
GCLK4
GCLK7
GCLK5
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