- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄16394 > VOICE-RECORD-RD (Silicon Laboratories Inc)KIT REF DESIGN VOICE RECORD F41X PDF資料下載
參數(shù)資料
| 型號(hào)： | VOICE-RECORD-RD |
| 廠商： | Silicon Laboratories Inc |
| 文件頁(yè)數(shù)： | 84/270頁(yè) |
| 文件大小： | 0K |
| 描述： | KIT REF DESIGN VOICE RECORD F41X |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 音頻，語(yǔ)音錄制/回放 |
| 嵌入式： | 是，MCU，8 位 |
| 已用 IC / 零件： | C8051F411-GM |
| 主要屬性： | MCU，87 秒，8 kHz， |
| 次要屬性： | 需要 Keil 編譯器和 USB 調(diào)試適配器 |
| 已供物品： | 板，電池，CD，耳機(jī)，電源 |
| 相關(guān)產(chǎn)品： | 336-1317-ND - KIT EVAL FOR C8051F411 |
| 其它名稱： | 336-1315 |
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C8051F410/1/2/3
174
Rev. 1.1
19.4. System Clock Selection
The internal oscillator requires little start-up time and may be selected as the system clock immediately fol-
lowing the OSCICN write that enables the internal oscillator. External crystals and ceramic resonators typ-
ically require a start-up time before they are settled and ready for use. The Crystal Valid Flag (XTLVLD in
register OSCXCN) is set to ‘1’ by hardware when the external oscillator is settled.
To avoid reading a
false XTLVLD, in crystal mode software should delay at least 1 ms between enabling the external
oscillator and checking XTLVLD. RC and C modes typically require no startup time.
The CLKSL[1:0] bits in register CLKSEL select which oscillator source is used as the system clock.
CLKSL[1:0] must be set to 01b for the system clock to run from the external oscillator; however the exter-
nal oscillator may still clock certain peripherals (timers, PCA) when another oscillator is selected as the
system clock. The system clock may be switched on-the-fly between the internal oscillator, external oscilla-
tor, smaRTClock oscillator, and Clock Multiplier, as long as the selected clock source is enabled and has
settled.
SFR Definition 19.5. CLKSEL: Clock Select
Bits7–6: Unused. Read = 00b; Write = don’t care.
Bits5–4: CLKDIV1–0: Output /SYSCLK Divide Value
These bits can be used to pre-divide the /SYSCLK output before it is sent to a port pin
through the Crossbar.
00: Output will be SYSCLK.
01: Output will be SYSCLK/2.
10: Output will be SYSCLK/4.
11: Output will be SYSCLK/8.
Bit3:
Unused. Read = 0b; Write = don’t care.
Bit2:
Reserved. Read = 0b; Must write 0b.
Bits1–0: CLKSL1–0: System Clock Select
These bits select the system clock source.
R
R/W
R
R/W
Reset Value
-
CLKDIV
-
Reserved
CLKSL
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0xA9
CLKSL
Selected Clock
00
Internal Oscillator (as determined by the
IFCN bits in register OSCICN)
01
External Oscillator
10
Clock Multiplier
11
smaRTClock Oscillator
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L-15F1R8JV4E | WIREWOUND INDUCTOR 1800NH 0805 |
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參數(shù)描述 |
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| VOL-0300 | 制造商:3M Electronic Products Division 功能描述:BLANK PORT INSERT WHITE |
| VOL-0300B | 制造商:3M Electronic Products Division 功能描述:BLANK PORT INSERT BRIGHT WHITE |
| VOL-0300BK | 制造商:3M Electronic Products Division 功能描述:BLANK PORT INSERT BLACK |
| VOL-0300G | 制造商:3M Electronic Products Division 功能描述:BLANK PORT INSERT GRAY |
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