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參數(shù)資料
| 型號： | UPD75238 |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 137/190頁 |
| 文件大?。?/td> | 1702K |
| 代理商： | UPD75238 |
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137
μ
PD75238
(3) Interrupt priority specification register (IPS)
The interrupt priority specification register specifies an interrupt with a higher priority from multiple
interrupts using the low-order three bits.
Bit 3, interrupt master enable flag (IME), specifies whether to disable all interrupts.
The IPS is set with a 4-bit memory manipulation instruction. Bit 3 is set with an EI instruction and reset
with a DI instruction.
When changing the low-order three bits of the IPS, interrupts must be disabled (IME = 0) beforehand.
A RESET input clears all bits to 0.
Fig. 5-5 Interrupt Priority Specification Register
IPS0
IPS1
IPS2
IPS3
0
1
2
3
IPS
Symbol
FB2H
Address
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
0
1
High-order interrupt selection
All low-order interrupt
VRQ1 (INTBT/INT4)
VRQ2 (INT0)
VRQ3 (INT1)
VRQ4 (INTCSI0)
VRQ5 (INTT0)
VRQ6 (INTTPG)
VRQ7 (INTKS)
The listed vector
interrupts are treated
as high-order interrupts.
Interrupt master enable flag (IME)
All interrupts are disabled and no vector interrupt is
activated.
The interrupt enable flag corresponding to an interrupt
request flag controls interrupt enabling/disabling.
相關(guān)PDF資料 |
PDF描述 |
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