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參數(shù)資料
| 型號： | UPD75238 |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 131/190頁 |
| 文件大?。?/td> | 1702K |
| 代理商： | UPD75238 |
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131
μ
PD75238
Vector interrupt request
signal (vector table
address)
In/out
INTBT
(Reference time interval signal from basic
interval timer)
INT4
(Detection of rising or falling edge)
INT0
(Rising/falling edge detection specification)
INT1
INTCSI0
(Serial data transfer completion signal)
INTT0
(Match signal from timer enter/counter 0)
INTTPG
(Match signal from timer/pulse generator)
INTKS
(Key scan timing signal from display controller)
INT2
Note 2
(Detection of rising edge )
INTW
Note 2
(Signal from clock timer)
Interrupt source
In
Out
Out
Out
In
In
In
In
Out
In
Priority
Note 1
1
2
3
4
5
6
7
VRQ1 (0002H)
VRQ2 (0004H)
VRQ3 (0006H)
VRQ4 (0008H)
VRQ5 (000AH)
VRQ6 (000CH)
VRQ7 (000EH)
Testable input signal (Sets IRQ2 and IRQW.)
5. INTERRUPT FUNCTION
The
μ
PD75238 has eight interrupt sources and can handle multiple interrupts with a priority.
The
μ
PD75238 is also provided with two test sources. One test source, INT2, is set by edge detection testable
input.
Table 5-1 Interrupt Sources
Notes 1.
The priority is used when two or more interrupt requests are issued at a time.
2.
INT2 and INTW are test sources. Like interrupt sources, these test sources are controlled by an
interrupt enable flag. But, they do not cause vector interrupts.
The following functions are provided for the interrupt control circuit of the
μ
PD75238.
(a) Vector interrupt function under hardware control which can determine whether to accept an interrupt by
an interrupt enable flag (IE
×××
) and the interrupt master enable flag (IME)
(b) Any interrupt start address can be set.
(c) Multiple interrupt function which can specify the priority by the interrupt priority specification register
(IPS)
(d) Test function of an interrupt request flag (IRQ
×××
)
(The software can confirm that an interrupt occurred.)
(e) Release of the standby mode (Interrupts released by an interrupt enable flag can be selected.)
5.1 CONFIGURATION OF THE INTERRUPT CONTROL CIRCUIT
The interrupt control circuit of the
μ
PD75238 is configured as shown in Fig. 5-1. Each hardware item is
mapped in the data memory space.
相關PDF資料 |
PDF描述 |
|---|---|
| UPD75238GJ | 4 BIT SINGLE-CHIP MICROCOMPUTER |
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參數(shù)描述 |
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