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參數(shù)資料
| 型號： | UPD75238 |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 124/190頁 |
| 文件大?。?/td> | 1702K |
| 代理商： | UPD75238 |
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124
μ
PD75238
(6) Dimmer select register (DIMS)
The dimmer select register (DIMS) is a 4-bit register for specifying a digit signal cut width to prevent display
light leakage and to use the dimmer function (for intensity control). In addition, the register is used to
select a display cycle (T
DSP
).
Fig. 4-72 shows the format of DIMS.
DIMS is set with a 4-bit memory manipulation instruction.
A display cycle of 341
μ
s at 6.0 MHz
Note 1
is usually selected by setting 1 in DIMS.0 for reduced light leakage.
However, as the number of display digits increases, the display cycle becomes closer to the frequency
of commercial power, causing the display to fricker. In this case, a display cycle of 171
μ
s at 6.0 MHz
Note
2
should be selected. If light leakage occurs in this case, adjust cutting width of the digit single by setting
DIMS.1, DIMS.2, and DIMS.3.
A RESET input clears all bits to 0.
Notes 1.
489
μ
s at 4.19 MHz
2.
244
μ
s at 4.19 MHz
Fig. 4-72 Dimmer Select Register Format
Notes 1.
244
μ
s at 4.19 MHz
2.
489
μ
s at 4.19 MHz
DIMS3
DIMS2
DIMS1
DIMS0
Address
F89H
Symbol
DIMS
Digit signal cut width specification bit
DIMS3
0
0
0
0
1
1
1
1
DIMS2
0
0
1
1
0
0
1
1
DIMS1
0
1
0
1
0
1
0
1
Digit signal cut width
1/16
2/16
4/16
6/16
8/16
10/16
12/16
14/16
Display cycle specification bit
DIMS0
0
1
A display cycle is 1f
Note 1
X
A display cycle is 2f
Note 2
X
μ
μ
相關(guān)PDF資料 |
PDF描述 |
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