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參數(shù)資料
| 型號： | UPD75237GJ |
| 廠商： | NEC Corp. |
| 英文描述： | TRANSISTOR NPN 800MA 45V SOT23 |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 42/191頁 |
| 文件大?。?/td> | 1255K |
| 代理商： | UPD75237GJ |
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42
μ
PD75237
(1)
Digital input/output port configuration
The digital input/output port configurations are shown in Figs. 4-2 to 4-11.
(2)
Input/output mode setting
The input/output mode of each input/output port is set by the port mode register as shown in Fig. 4-12.
Each port acts as an input when the corresponding port mode register bit is “0” and as an output port when
the bit is “1”.
Port mode register groups A and B each are set by the 8-bit memory manipulation instruction.
Upon RESET input, all bits of each port mode register are cleared to “0”. Thus, the output buffer is turned
OFF and all the ports are set to the input mode.
(3) Digital input/output port operation
The operations of the port and pin for instruction execution vary, depending on the input/output mode
setting as shown in Table 4-1.
Table 4-1 Input/Output Port Operations for Input/Output Instruction Execution
Input Mode (Corresponding
Bit 0 of Mode Register)
[Output Buffer OFF]
Output Mode (Corresponding
Bit 1 of Mode Register)
[Output Buffer ON]
When 1-bit test instruction,
1-bit input instruction, 4-bit or 8-bit in-
struction is executed
When 4-bit or 8-bit output instruction is
executed
When 1-bit output instruction
*
is executed
Each pin data input
Accumulator data transfer to out-
put latch
Output latch contents become un-
defined
Output latch contents input
Accumulator data output to out-
put pin
Output pin status change accord-
ing to instruction
*
SET1/CLR1/MOV1 PORTn.bit, CY, etc.
相關(guān)PDF資料 |
PDF描述 |
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