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參數(shù)資料
| 型號： | TUSB3410VF |
| 英文描述： | BUS CONTROLLER |
| 中文描述： | 總線控制器 |
| 文件頁數(shù)： | 54/92頁 |
| 文件大?。?/td> | 317K |
| 代理商： | TUSB3410VF |
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7
–
8
BIT
7
FUNCTION
RESET
0
NAME
LCD
During loopback, this bit reflects the status of MCR[3] (see Figure 7
–
1).
LCD = 0
LCD = 0
CD input is low
CD input is high
7.1.9
DLL: Divisor Register Low Byte (Addr:FFA7)
This register contains the low byte of the baud-rate divisor.
7
6
5
4
3
2
1
0
D7
D6
D5
D4
D3
D2
D1
D0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
BIT
7
–
0
NAME
D[7:0]
RESET
08h
FUNCTION
Low-byte value of the 16-bit divisor for generation of the baud clock in the baud-rate generator.
7.1.10 DLH: Divisor Register High Byte (Addr:FFA8)
This register contains the high byte of the baud-rate divisor.
7
6
5
4
3
2
1
0
D15
D14
D13
D12
D11
D10
D9
D8
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
BIT
7
–
0
NAME
D[15:8]
RESET
00h
FUNCTION
High-byte value of the 16-bit divisor for generation of the baud clock in the baud-rate generator.
7.1.11 Baud-rate Calculation
The following formulas are used to calculate the baud-rate clock and the divisors. The baud-rate clock is derived from
the 96-MHz master clock (dividing by 6.5). The table below presents the divisors used to achieve the desired baud
rates, together with the associate rounding errors.
Baud CLK
96 MHz
6.5
14.76923077 MHz
Divisor
14.76923077
Baud Rate
10
6
16
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