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參數(shù)資料
| 型號： | ST72124J2T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 8-BIT MCU WITH SINGLE VOLTAGE FLASH MEMORY, ADC, 16-BIT TIMERS, SPI, SCI INTERFACES |
| 中文描述： | 8位單電壓閃存，ADC和16位定時器，SPI和脊髓損傷界面微控制器 |
| 文件頁數(shù)： | 34/153頁 |
| 文件大?。?/td> | 1533K |
| 代理商： | ST72124J2T |
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ST72334J/N, ST72314J/N, ST72124J
34/153
INTERRUPTS
(Cont’d)
Figure 18. Interrupt Processing Flowchart
Table 5. Interrupt mapping
Note 1.
Valid for HALT and ACTIVE-HALT modes except for the MCC/RTC or CSS interrupt source which exits from
ACTIVE-HALT mode only.
N°
Source
Block
Description
Register
Label
Priority
Order
Exit
from
HALT
1)
yes
no
Address
Vector
RESET
TRAP
Reset
Software Interrupt
Not used
Main Clock Controller Time Base Interrupt
or Clock Security System Interrupt
External Interrupt Port A3..0
External Interrupt Port F2..0
External Interrupt Port B3..0
External Interrupt Port B7..4
Not used
SPI Peripheral Interrupts
TIMER A Peripheral Interrupts
TIMER B Peripheral Interrupts
SCI Peripheral Interrupts
Data-EEPROM Data EEPROM Interrupt
N/A
Highest
Priority
Lowest
Priority
FFFEh-FFFFh
FFFCh-FFFDh
FFFAh-FFFBh
0
1
MCC/RTC
CSS
ei0
ei1
ei2
ei3
MCCSR
CRSR
yes
FFF8h-FFF9h
2
3
4
5
6
7
8
9
N/A
FFF6h-FFF7h
FFF4h-FFF5h
FFF2h-FFF3h
FFF0h-FFF1h
FFEEh-FFEFh
FFECh-FFEDh
FFEAh-FFEBh
FFE8h-FFE9h
FFE6h-FFE7h
FFE4h-FFE5h
FFE2h-FFE3h
FFE0h-FFE1h
SPI
SPISR
TASR
TBSR
SCISR
EECSR
no
TIMER A
TIMER B
SCI
10
11
12
13
Not used
I BIT SET
Y
N
IRET
Y
N
FROM RESET
LOAD PC FROM INTERRUPT VECTOR
STACK PC, X, A, CC
SET I BIT
FETCH NEXT INSTRUCTION
EXECUTE INSTRUCTION
THIS CLEARS I BIT BY DEFAULT
RESTORE PC, X, A, CC FROM STACK
INTERRUPT
PENDING
Y
N
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