參數(shù)資料
型號: SI5324D-C-GMR
廠商: Silicon Laboratories Inc
文件頁數(shù): 47/72頁
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描述: IC CLOCK MULT 2KHZ-150MHZ 36VQFN
標準包裝: 250
系列: DSPLL®
類型: 時鐘/頻率倍增器,抖動衰減器,多路復用器
PLL:
主要目的: 以太網(wǎng)(WAN),SONET/SDH/STM,視頻
輸入: 時鐘
輸出: CML,CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 150MHz
電源電壓: 1.71 V ~ 3.63 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 36-VFQFN 裸露焊盤
供應商設備封裝: 36-QFN(6x6)
包裝: 帶卷 (TR)
Si5324
Rev. 1.1
51
Reset value = 0000 0001
Register 130.
Bit
D7
D6
D5
D4
D3
D2
D1
D0
Name
DIGHOLDVALID
FOS2_INT
FOS1_INT
LOL_INT
Type
RR
R
Bit
Name
Function
7
Reserved
Reserved.
6DIGHOLDVALID
Digital Hold Valid.
Indicates if the digital hold circuit has enough samples of a valid clock to meet dig-
ital hold specifications.
0: Indicates digital hold history registers have not been filled. The digital hold
output frequency may not meet specifications.
1: Indicates digital hold history registers have been filled. The digital hold output
frequency is valid.
5:3
Reserved
Reserved.
2
FOS2_INT
CKIN2 Frequency Offset Status.
0: Normal operation.
1: Internal frequency offset alarm on CKIN2 input.
1
FOS1_INT
CKIN1 Frequency Offset Status.
0: Normal operation.
1: Internal frequency offset alarm on CKIN1 input.
0
LOL_INT
PLL Loss of Lock Status.
0: PLL locked.
1: PLL unlocked.
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PDF描述
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參數(shù)描述
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