參數(shù)資料
型號(hào)： SI5324D-C-GMR
廠商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 17/72頁(yè)
文件大小： 0K
描述： IC CLOCK MULT 2KHZ-150MHZ 36VQFN
標(biāo)準(zhǔn)包裝： 250
系列： DSPLL®
類(lèi)型： 時(shí)鐘/頻率倍增器，抖動(dòng)衰減器，多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)（WAN），SONET/SDH/STM，視頻
輸入： 時(shí)鐘
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 150MHz
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 36-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 36-QFN（6x6）
包裝： 帶卷 (TR)
Si5324
24
Rev. 1.1
4. Register Map
All register bits that are not defined in this map should always be written with the specified Reset Values. The
writing to these bits of values other than the specified Reset Values may result in undefined device behavior.
Registers not listed, e.g. Register 64, should never be written to.
Register
D7
D6
D5
D4
D3
D2
D1
D0
0
FREE_RUN
CKOUT_
ALWAYS_ON
BYPASS_REG
1
CK_PRIOR2[1:0]
CK_PRIOR1[1:0]
2
BWSEL_REG[3:0]
3
CKSEL_REG[1:0]
DHOLD
SQ_ICAL
4
AUTOSEL_REG[1:0]
HST_DEL[4:0]
5
ICMOS[1:0]
6
SFOUT2_REG[2:0}
SFOUT1_REG[2:0]
7
FOSREFSEL[2:0]
8
HLOG_2[1:0]
HLOG_1[1:0]
9
HIST_AVG[4:0]
10
DSBL2_ REG
DSBL1_ REG
11
PD_CK2
PD_CK1
19
FOS_EN
FOS_THR[1:0]
VALTIME[1:0]
LOCK[T2:0]
20
CK2_BAD_PIN
CK1_ BAD_ PIN
LOL_PIN
INT_PIN
21
CK1_ACTV_PIN
CKSEL_PIN
22
CK_ACTV_ POL CK_BAD_ POL
LOL_POL
INT_POL
23
LOS2_MSK
LOS1_MSK
LOSX_MSK
24
FOS2_MSK
FOS1_MSK
LOL_MSK
25
N1_HS[2:0]
31
NC1_LS[19:16]
32
NC1_LS[15:8]
33
NC1_LS[7:0]
34
NC2_LS[19:16]
35
NC2_LS[15:8]
36
NC2_LS[7:0]
40
N2_HS[2:0]
N2_LS[19:16]
41
N2_LS[15:8]
42
N2_LS[7:0]
43
N31[18:16]
44
N31[15:8]
45
N31[7:0]
46
N32[18:16]
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PDF描述
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