參數(shù)資料
型號： SI3216MDC1-EVB
廠商： Silicon Laboratories Inc
文件頁數(shù)： 55/122頁
文件大小： 0K
描述： DAUGHTER CARD W/SI3201 INTERFACE
標準包裝： 1
Si3216
38
Rev. 1.0
Not
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fo
r N
ew
D
esi
gn
s
Figure 21. Tone Generator Timing Diagram
Table 28. Associated Tone Generator Registers
Tone Generator 1
Parameter
Description/Range
Register Bits
Location
Oscillator 1 Frequency Coefficient
Sets oscillator frequency
OSC1[15:0]
Indirect Register 0
Oscillator 1 Amplitude Coefficient
Sets oscillator amplitude
OSC1X[15:0]
Indirect Register 1
Oscillator 1 initial phase coefficient
Sets initial phase
OSC1Y[15:0]
Indirect Register 2
Oscillator 1 Active Timer
0 to 8 s
OAT1[15:0]
Direct Registers 36 & 37
Oscillator 1 Inactive Timer
0 to 8 s
OIT1[15:0]
Direct Registers 38 & 39
Oscillator 1 Control
Status and control
registers
OSS1, REL, OZ1,
O1TAE, O1TIE,
O1E, O1SO[1:0]
Tone Generator 2
Parameter
Description/Range
Register
Location
Oscillator 2 Frequency Coefficient
Sets oscillator frequency
OSC2[15:0]
Indirect Register 3
Oscillator 2 Amplitude Coefficient
Sets oscillator amplitude
OSC2X[15:0]
Indirect Register 4
Oscillator 2 initial phase coefficient
Sets initial phase
OSC2Y[15:0]
Indirect Register 5
Oscillator 2 Active Timer
0 to 8 s
OAT2[15:0]
Direct Registers 40 & 41
Oscillator 2 Inactive Timer
0 to 8 s
OIT2[15:0]
Direct Registers 42 & 43
Oscillator 2 Control
Status and control
registers
OSS2, OZ2,
O2TAE, O2TIE,
O2E, O2SO[1:0]
...
0,1
...
0,1
...
..., OAT1
..., OIT1
0,1
...
0,1
...
O1E
OSS1
Tone
G en. 1
Signal
O utput
相關PDF資料
PDF描述
RSC12DRYN CONN EDGECARD 24POS DIP .100 SLD
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1838236-2 CONN MALE M12 3POS STR 3M CABLE
RMC12DRYN CONN EDGECARD 24POS DIP .100 SLD
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參數(shù)描述
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