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參數(shù)資料
| 型號： | sda 9362 |
| 廠商： | SIEMENS AG |
| 英文描述： | DDC-PLUS-Deflection Controller(DDC 過偏轉(zhuǎn)控制器) |
| 中文描述： | DDC的加偏轉(zhuǎn)控制器（DDC的過偏轉(zhuǎn)控制器） |
| 文件頁數(shù)： | 33/39頁 |
| 文件大?。?/td> | 199K |
| 代理商： | SDA 9362 |
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SDA 9362
Semiconductor Group
33
1998-02-01
3.2
Characteristics (Assuming Recommended Operating Conditions)
(cont’d)
Parameter
Symbol
Limit Values
nom.
Unit
Remark
min.
max.
DAC Output VD+, VD-
DAC resolution
14
Bit
Linear range:
1500 ... 15000
Input data = 1500
1)
Input data = 15000
1)
Input data = 1500
1)
DAC output low (VD-)
DAC output high (VD-)
DAC output low
(VD-) - (VD+)
DAC output high
(VD-) - (VD+)
Load capacitance
Output load
Zero error
Gain error
INL
DNL
1.44
3.58
-2.12
V
V
V
2.16
V
Input data = 15000
1)
C
L
30
pF
k
20
-1 %
-5 %
-0.5 %
Monotonous
1 %
5 %
0.5 %
(VD-) - (VD+) = 0 V
2)
2)
2)
Guar. by design
1)
V
REFH
= 2.5 V,
V
REFL
= 1.2 V
2)
V
REFH
= 2.5 V,
V
REFL
= 1.2 V, Input range = 1500 ... 15000
Reference Output
V
REFP
(Adjust. by Reg 48
H
, Bit D7 ... D2) (Reg 48
H
, Bit D1 = 0, Bit D0 = 0)
Output voltage min
Output voltage max
4.0
Output current
I
Q
-50
Reference Output
V
REFH
(Reg 48
H
, Bit D1 = 0)
Output voltage
V
Q
2.4
Reference Output
V
REFL
(Reg 48
H
, Bit D1 = 0)
Output voltage
V
Q
1.1
Output HD
Output low level
V
OL
0
Output high level
V
OH
V
DD
-1 V
4.0
V
V
μ
A
Bit D7 ... D2 = 100000
Bit D7 ... D2 = 011111
0
2.5
2.6
V
V
REFP
= 4 V
1.2
1.3
V
V
REFP
= 4 V
1
V
DD
V
I
O
= 8 mA
I
O
= -8 mA
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SDA9362 | DDC-PLUS-Deflection Controller |
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參數(shù)描述 |
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