參數(shù)資料
型號(hào)： SAA7146AH
廠商： NXP SEMICONDUCTORS
元件分類： 消費(fèi)家電
英文描述： .012UF/400VDC METAL POLY CAP
中文描述： SPECIALTY CONSUMER CIRCUIT, PQFP160
封裝： 28 X 28 MM, 3.40 MM HEIGHT, PLASTIC, SOT322-2, MS-022, QFP-160
文件頁(yè)數(shù)： 6/144頁(yè)
文件大?。?/td> 645K
代理商： SAA7146AH
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1998 Apr 09
6
Philips Semiconductors
Product specification
Multimedia bridge, high performance
Scaler and PCI circuit (SPCI)
SAA7146A
6
PINNING
Pin description for QFP160
SYMBOL
PIN
STATUS
DESCRIPTION
D1_A0
D1_A1
D1_A2
D1_A3
V
DDD1
V
SSD1
D1_A4
D1_A5
D1_A6
D1_A7
VS_A
HS_A
LLC_A
PXQ_A
V
DDD2
V
SSD2
TRST
TMS
1
2
3
4
5
6
7
8
9
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13
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16
17
18
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I/O
I/O
I/O
P
P
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
P
P
I
I
bidirectional digital CCIR 656 D1 port A bit 0
bidirectional digital CCIR 656 D1 port A bit 1
bidirectional digital CCIR 656 D1 port A bit 2
bidirectional digital CCIR 656 D1 port A bit 3
digital supply voltage 1 (3.3 V)
digital ground 1
bidirectional digital CCIR 656 D1 port A bit 4
bidirectional digital CCIR 656 D1 port A bit 5
bidirectional digital CCIR 656 D1 port A bit 6
bidirectional digital CCIR 656 D1 port A bit 7
bidirectional vertical sync signal port A
bidirectional horizontal sync signal port A
bidirectional line-locked system clock port A
bidirectional pixel qualifier signal to mark valid pixels port A; note 1
digital supply voltage 2 (3.3 V)
digital ground 2
test reset input (JTAG pin must be set LOW for normal operation)
test mode select input (JTAG pin must be floating or set to HIGH during normal
operation)
test clock input (JTAG pin should be set LOW during normal operation)
test data output (JTAG pin not active during normal operation)
test data input (JTAG pin must be floating or set to HIGH during normal operation)
digital supply voltage 3 (3.3 V)
digital ground 3
PCI interrupt line output (active LOW)
PCI global reset input (active LOW)
PCI clock input
bus grant input signal, PCI arbitration signal (active LOW)
bus request output signal, PCI arbitration signal (active LOW)
digital supply voltage 4 (3.3 V)
digital ground 4
bidirectional PCI multiplexed address/data bit 31
bidirectional PCI multiplexed address/data bit 30
bidirectional PCI multiplexed address/data bit 29
bidirectional PCI multiplexed address/data bit 28
digital supply voltage 5 (3.3 V)
digital ground 5
bidirectional PCI multiplexed address/data bit 27
TCLK
TDO
TDI
V
DDD3
V
SSD3
INTA#
RST
CLK
GNT#
REQ#
V
DDD4
V
SSD4
AD PCI31
AD PCI30
AD PCI29
AD PCI28
V
DDD5
V
SSD5
AD PCI27
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
I
O
I
P
P
O
I
I
I
O
P
P
I/O
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I/O
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P
P
I/O
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PDF描述
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參數(shù)描述
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