參數(shù)資料
型號(hào): S5935TF
廠商: APPLIEDMICRO INC
元件分類: 總線控制器
英文描述: PCI 5V Bus Master/Target Device 32-bit
中文描述: PCI BUS CONTROLLER, PQFP208
封裝: TQFP-208
文件頁數(shù): 61/190頁
文件大?。?/td> 748K
代理商: S5935TF
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4-53
PCI BUS OPERATION REGISTERS
S5935
INTERRUPT CONTROL/STATUS
REGISTER (INTCSR)
Register Name:
PCI Address Offset: 38h
Power-up value:
Attribute:
Interrupt Control and Status
00000000h
Read/Write (R/W),
Read/Write_One_Clear (R/WC)
32 bits
Size:
This register provides the method for choosing which
conditions are to produce an interrupt on the PCI bus
interface, a method for viewing the cause of the inter-
rupt, and a method for acknowledging (removing) the
interrupt’s assertion.
Interrupt sources:
Write Transfer Terminal Count = zero
Read Transfer Terminal Count = zero
One of the Outgoing mailboxes (1,2,3 or 4)
becomes empty
One of the Incoming mailboxes (1,2,3 or 4)
becomes full.
Target Abort
Master Abort
Figure 6. Interrupt Control/Status Register
31
FIFO and Endian Control
0
15 14
12
8
4
Bit
Value
16
21
23
24
0
Read Transfer
Complete (R/WC)
Write Transfer
Complete (R/WC)
Incoming Mailbox
Interrupt (R/WC)
Outgoing Mailbox
Interrupt (R/WC)
Interrupt Asserted (RO)
Target Abort (R/WC)
Master Abort (R/WC)
0
0 0 0
D4-D0 Outgoing Mailbox
(Goes empty)
D4=Enable Interrrupt
D3-D2=Mailbox #
0 0=Mailbox 1
0 1=Mailbox 2
1 0=Mailbox 3
1 1=Mailbox 4
D1-D0=Byte #
0 0=Byte 0
0 1=Byte 1
1 0=Byte 2
1 1=Byte 3
D12-D8 Incoming Mailbox (R/W)
(Becomes full)
D12=Enable Interrupt
D11-D10=Mailbox
0 0=Mailbox 1
0 1=Mailbox 2
1 0=Mailbox 3
1 1=Mailbox 4
D9-D8=Byte #
0 0=Byte 0
0 1=Byte 1
1 0=Byte 2
1 1=Byte 3
Interrupt on Write
Transfer Complete
Interrupt on Read
Transfer Complete
Interrupt Source (R/W)
Enable & Selection
Actual Interrupt
Interrupt Selection
相關(guān)PDF資料
PDF描述
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S5935QF PCI 5V Bus Master/Target Device 32-bit
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