參數(shù)資料
型號： S1D13A05F00A100
元件分類： 顯示控制器
英文描述： 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121
封裝： LEAD FREE, PLASTIC, FBGA-121
文件頁數(shù)： 409/592頁
文件大?。?/td> 5281K
代理商： S1D13A05F00A100
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Epson Research and Development
Page 11
Vancouver Design Center
Interfacing to the PC Card Bus
S1D13A05
Issue Date: 02/01/29
X40A-G-005-01
3.2 Host Bus Interface Signals
The S1D13A05 Generic #2 Host Bus Interface requires the following signals from the PC
Card bus.
CLKI is a clock input which is required by the S1D13A05 Host Bus Interface as a
source for its internal bus and memory clocks. This clock is typically driven by the host
CPU system clock. Since the PC Card signalling is independent of any clock, CLKI can
come from any oscillator already implemented. For example, the source for the CLKI2
input of the S1D13A05 may be used.
The address inputs AB[17:0], and the data bus DB[15:0], connect directly to the PC
Card address (A[17:0]) and data bus (D[15:0]), respectively. CNF4 must be set to select
little endian mode.
Chip Select (CS#) is driven by decoding the high-order address lines to select the proper
register and memory address space.
M/R# (memory/register) selects between memory or register accesses. This signal is
generated by the external address decode circuitry. For this example, M/R# is connected
to address line A18, allowing system address A18 to select between memory or register
accesses.
WE1# connects to -CE2 (the high byte chip select signal from the PC Card interface)
which in conjunction with address bit 0 allows byte steering of read and write opera-
tions.
WE0# connects to -WE (the write enable signal form the PC Card bus) and must be
driven low when the PC Card bus is writing data to the S1D13A05.
RD# connects to -OE (the read enable signal from the PC Card bus) and must be driven
low when the PC Card bus is reading data from the S1D13A05.
WAIT# is a signal output from the S1D13A05 that indicates the PC Card bus must wait
until data is ready (read cycle) or accepted (write cycle) on the host bus. Since PC Card
bus accesses to the S1D13A05 may occur asynchronously to the display update, it is
possible that contention may occur in accessing the S1D13A05 internal registers and/or
display buffer. The WAIT# line resolves these contentions by forcing the host to wait
until the resource arbitration is complete.
The Bus Status (BS#) and Read/Write (RD/WR#) signals are not used in this implemen-
tation of the PC Card bus using the Generic #2 Host Bus Interface. These pins must be
tied high (connected to IO VDD).
The RESET# (active low) input of the S1D13A05 may be connected to the PC Card
RESET (active high) using an inverter.
相關PDF資料
PDF描述
S1R72005F00A300 UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
S1R72105F00A000 SCSI BUS CONTROLLER, PQFP100
S1R72803F00A100 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100
S1R72C05B08 UNIVERSAL SERIAL BUS CONTROLLER, PBGA121
S1R72C05B10 UNIVERSAL SERIAL BUS CONTROLLER, PBGA121
相關代理商/技術參數(shù)
參數(shù)描述
S1D13A05F00A200 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP
S1D-13-F 功能描述:整流器 200V 1A RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
S1D13T03F10A100 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER 64TQFP13 制造商:Epson Electronics America Inc 功能描述:EPD Controller Timing control
S1D13T04F10E100 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER
S1D13U11F00A 功能描述:顯示驅(qū)動器和控制器 USB -LCDC Controller RoHS:否 制造商:Panasonic Electronic Components 工作電源電壓:2.7 V to 5.5 V 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:QFN-44 封裝:Reel
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