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參數(shù)資料
| 型號： | S1D13A05F00A100 |
| 元件分類： | 顯示控制器 |
| 英文描述： | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| 封裝： | LEAD FREE, PLASTIC, FBGA-121 |
| 文件頁數(shù)： | 339/592頁 |
| 文件大?。?/td> | 5281K |
| 代理商： | S1D13A05F00A100 |
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Epson Research and Development
Page 15
Vancouver Design Center
Windows CE 3.x Display Driver
S1D13A05
Issue Date: 02/04/04
X40A-E-002-01
Comments
The display driver is CPU independent, allowing use of the driver code for several
Windows CE Platform Builder supported platforms. The file s1dflat.cpp will require
editing for the correct values of PhysicalPortAddr, PhysicalVmemAddr, etc.
The sample code defaults to a 320x240 8-bit color passive LCD panel in SwivelView 0°
mode (landscape) with a color depth of 8 bpp. To support other settings, use
13a05cfg.exe to generate a proper mode0.h file. For further information, refer to the
13A05CFG Configuration Program User Manual, document number X40A-B-001-xx.
By default, the 13A05CFG program assumes PCI addressing for the S1D13A05 evalua-
tion board. This means that the display driver will automatically locate the S1D13A05
by scanning the PCI bus (currently only supported for the CEPC platform). If you select
the address option “Other” and fill in your own custom addresses for the registers and
video memory, then the display driver will not scan the PCI bus and will use the specific
addresses you have chosen.
If you are running the display driver on hardware other than the S1D13A05 evaluation
board, you must ensure that your hardware provides the correct clock frequencies for
CLKI and CLKI2. 13A05CFG defaults to 50MHz for both CLKI and CLKI2.
On the evaluation board, the display driver will correctly program the clock chip to
support the CLKI and CLKI2 frequencies. On customer hardware, you must ensure that
the clocks you provide to all clock inputs match the settings you chose in the Clocks tab
of the 13A05CFG program. For more information on setting the clocks, see the
13A05CFG Configuration Program User Manual, document number X40A-B-001-xx.
If you run the S1D13A05 with a single clock source, make sure your clock sources for
PCLK, BCLK, and MCLK are correctly set to use the correct clock input source. Also
ensure that you enable the clock dividers as required for different display hardware.
If you are using 13a05cfg.exe to produce multiple MODE tables, make sure you change
the Mode Number setting for each mode table you generate. The display driver supports
multiple mode tables, but only if each mode table has a unique mode number. For more
information on setting the mode number, see the 13A05CFG Configuration Program
User Manual, document number X40A-B-001-xx.
13A05CFG assumes you are using the S1D13A05 evaluation board, and defaults the
Panel Power control to GPIO0. 13A05CFG allows you to change the GPIO pin used to
control panel power, or to disable the use of GPIO pins altogether. If this is changed
from the default, your driver will no longer be able to control panel power on the
S1D13A05 evaluation board, and your panel may not be powered up correctly.
At this time, the driver has been tested on the x86 CPUs and have been run with Plat-
form Builder v3.00.
相關(guān)PDF資料 |
PDF描述 |
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| S1R72803F00A100 | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| S1D-13-F | 功能描述:整流器 200V 1A RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| S1D13T03F10A100 | 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER 64TQFP13 制造商:Epson Electronics America Inc 功能描述:EPD Controller Timing control |
| S1D13T04F10E100 | 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER |
| S1D13U11F00A | 功能描述:顯示驅(qū)動器和控制器 USB -LCDC Controller RoHS:否 制造商:Panasonic Electronic Components 工作電源電壓:2.7 V to 5.5 V 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:QFN-44 封裝:Reel |
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