參數(shù)資料
型號： S1D13A05F00A100
元件分類： 顯示控制器
英文描述： 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121
封裝： LEAD FREE, PLASTIC, FBGA-121
文件頁數(shù)： 235/592頁
文件大?。?/td> 5281K
代理商： S1D13A05F00A100
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Epson Research and Development
Page 25
Vancouver Design Center
Hardware Functional Specification
S1D13A05
Issue Date: 2003/05/01
X40A-A-001-04
Revision 4.0
RD/WR#
F3
LI
This input pin has multiple functions.
For Generic #1, this pin inputs the read command for the upper data
byte (RD1#).
For Generic #2, this pin must be tied to IO VDD.
For SH-3/SH-4, this pin inputs the RD/WR# signal. The S1D13A05
needs this signal for early decode of the bus cycle.
For MC68K #1, this pin inputs the R/W# signal.
For MC68K #2, this pin inputs the R/W# signal.
For REDCAP2, this pin inputs the R/W signal.
For DragonBall, this pin must be tied to IO VDD.
RD#
E1
LI
This input pin has multiple functions.
For Generic #1, this pin inputs the read command for the lower data byte
(RD0#).
For Generic #2, this pin inputs the read command (RD#).
For SH-3/SH-4, this pin inputs the read signal (RD#).
For MC68K #1, this pin must be tied to IO VDD.
For MC68K #2, this pin inputs the bus size bit 1 (SIZ1).
For REDCAP2, this pin inputs the output enable (OE).
For DragonBall, this pin inputs the output enable (OE).
WAIT#
G1
LB2A
Hi-Z
During a data transfer, this output pin is driven active to force the system to
insert wait states. It is driven inactive to indicate the completion of a data
transfer. WAIT# is released to the high impedance state after the data
transfer is complete. Its active polarity is configurable.
For Generic #1, this pin outputs the wait signal (WAIT#).
For Generic #2, this pin outputs the wait signal (WAIT#).
For SH-3 mode, this pin outputs the wait request signal (WAIT#).
For SH-4 mode, this pin outputs the device ready signal (RDY#).
For MC68K #1, this pin outputs the data transfer acknowledge signal
(DTACK#).
For MC68K #2, this pin outputs the data transfer and size acknowledge
bit 1 (DSACK1#).
For REDCAP2, this pin is unused (Hi-Z).
For DragonBall, this pin outputs the data transfer acknowledge signal
(DTACK).
Note: This pin should be tied to the inactive voltage level as selected by
CNF5, using a pull-up or pull-down resistor. If CNF5 = 1, the WAIT# pin
should be tied low using a pull-down resistor. If CNF5 = 0, the WAIT# pin
should be tied high using a pull-up resistor. If WAIT# is not used, this pin
should be tied either high or low using a pull-up or pull-down resistor.
RESET#
F1
LI
Active low input to set all internal registers to the default state and to force all
signals to their inactive states.
Table 4-2: Host Interface Pin Descriptions
Pin Name
PFBGA
Pin #
I/O type
(see key
above)
RESET#
State
Description
相關PDF資料
PDF描述
S1R72005F00A300 UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
S1R72105F00A000 SCSI BUS CONTROLLER, PQFP100
S1R72803F00A100 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100
S1R72C05B08 UNIVERSAL SERIAL BUS CONTROLLER, PBGA121
S1R72C05B10 UNIVERSAL SERIAL BUS CONTROLLER, PBGA121
相關代理商/技術參數(shù)
參數(shù)描述
S1D13A05F00A200 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP
S1D-13-F 功能描述:整流器 200V 1A RoHS:否 制造商:Vishay Semiconductors 產品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
S1D13T03F10A100 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER 64TQFP13 制造商:Epson Electronics America Inc 功能描述:EPD Controller Timing control
S1D13T04F10E100 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER
S1D13U11F00A 功能描述:顯示驅動器和控制器 USB -LCDC Controller RoHS:否 制造商:Panasonic Electronic Components 工作電源電壓:2.7 V to 5.5 V 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:QFN-44 封裝:Reel
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