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參數(shù)資料
| 型號： | PXB4330E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 128/185頁 |
| 文件大?。?/td> | 2552K |
| 代理商： | PXB4330E |
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3;%(
Data Sheet
4-128
04.2000
2SHUDWLRQ
,QLWLDOL]DWLRQDQG7HVW
These are the actions to be performed after reset to prepare the AOP for operation.
Check reset values of all registers
Set HW configuration (RAM type, UTOPIA configuration)
Initialize internal and external RAMs
For this purpose the DMA feature of the chip could be used.
Test parity detectors
Check data path (via adjacent ATM devices)
&RQILJXUDWLRQ
The following parameters must be known by the microprocessor for the operation of the AOP:
Number of PHYs
Edge-of-the-network or intra-network point for each PHY
Switch Port ID for intra-network Loopback
Number of supported connections
Thresholds for PM data collection values
Use of internal CC function or not.
6HWXS &OHDUGRZQRI&RQQHFWLRQV
For a connection setup the following parameters are required:
Local connection identifier LCI
VPC or VCC
If VCC the LCI2 value of the associated VP-entry (VP-pointer)
VCC endpoint indication (at AAL function)
PHY number
All further programming is done using the edge-of-the-network or intra-network configuration of
the PHY (for the abbreviations see
6HFWLRQ
):
In case of a VCC the upstream part of the AOP is configured as VP-TEP and the downstream
part as VP-OEP. If in addition the PHY is configured as edge of a network the upstream part
is configured as VC-OSP and the downstream part as VC-TSP.
In case of a VPC without a segment border both up- and downstream parts are configured as
intermediate point (VP-IP). If the PHY is configured as edge of the network the upstream part
is configured as VP-OSP and the downstream part as VP-TSP.
1RWH
,ID3+<LVDWWKHHGJHRIDQHWZRUNLWVWUDQVPLVVLRQOLQHLVFRQQHFWHGWRWKHQHWZRUNRIDQRWKHURSHUDWRU
+HQFHDOOVHJPHQWVWUHDPVDUHWHUPLQDWHGEHIRUHWKH$70FHOOVOHDYHWKHQRGHQRQRYHUODSSLQJPRGH
At OEPs the CC flow generation is enabled (VPC or VCC, segment or end-to-end).
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