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參數(shù)資料
| 型號： | P89V51RB2FA,529 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 25/80頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 80C51 MCU FLASH 16K 44-PLCC |
| 產(chǎn)品培訓模塊： | Migrating from 8/16-Bit MCUs to 32-Bit ARMs |
| 標準包裝： | 156 |
| 系列： | 89V |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 16KB（16K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 706 (CN2011-ZH PDF) |
| 配用： | 622-1017-ND - BOARD 44-ZIF PLCC SOCKET 622-1001-ND - USB IN-CIRCUIT PROG 80C51ISP |
| 其它名稱： | 568-2427-5 935278706529 P89V51RB2FA-S |
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P89V51RB2_RC2_RD2_5
NXP B.V. 2009. All rights reserved.
Product data sheet
Rev. 05 — 12 November 2009
31 of 80
NXP Semiconductors
P89V51RB2/RC2/RD2
8-bit microcontrollers with 80C51 core
6.5 Timer 2
Timer 2 is a 16-bit Timer/counter which can operate as either an event timer or an event
counter, as selected by C/T2 in the special function register T2CON. Timer 2 has four
operating modes: Capture, Auto-reload (up or down counting), Clock-out, and Baud Rate
Fig 11. Timer/counter 0 mode 3 (two 8-bit counters)
002aaa522
osc/2
TR1
TR0
TnGate
INT0 pin
TL0
(8-bits)
TF0
control
overflow
interrupt
TH0
(8-bits)
TF1
control
overflow
interrupt
osc/6
T0 pin
C/T = 0
C/T = 1
Table 19.
Timer 2 operating mode
RCLK + TCLK
CP/RL2
TR2
T2OE
Mode
0
1
0
16-bit auto reload
0
1
0
16-bit capture
0
1
programmable clock-out
1
X
1
0
baud rate generator
X
0
X
off
Table 20.
T2CON - Timer/counter 2 control register (address C8H) bit allocation
Bit addressable; Reset value: 00H
Bit
7
6
5
4
3
2
1
0
Symbol
TF2
EXF2
RCLK
TCLK
EXEN2
TR2
C/T2
CP/RL2
Table 21.
T2CON - Timer/counter 2 control register (address C8H) bit description
Bit
Symbol
Description
7
TF2
Timer 2 overow ag set by a Timer 2 overow and must be cleared by
software. TF2 will not be set when either RCLK or TCLK = 1 or when
Timer 2 is in Clock-out mode.
6
EXF2
Timer 2 external ag is set when Timer 2 is in capture, reload or
baud-rate mode, EXEN2 = 1 and a negative transition on T2EX
occurs. If Timer 2 interrupt is enabled EXF2 = 1 causes the CPU to
vector to the Timer 2 interrupt routine. EXF2 must be cleared by
software.
5
RCLK
Receive clock ag. When set, causes the UART to use Timer 2
overow pulses for its receive clock in modes 1 and 3. RCLK = 0
causes Timer 1 overow to be used for the receive clock.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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