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參數(shù)資料
| 型號： | MT90401AB1 |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | SONET/SDH System Synchronizer |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PQFP80 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, LEAD FREE, MS-026BEC, LQFP-80 |
| 文件頁數(shù)： | 28/38頁 |
| 文件大?。?/td> | 650K |
| 代理商： | MT90401AB1 |
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MT90401
Data Sheet
28
Zarlink Semiconductor Inc.
Bit
Name
Functional Description
7-4
RSV
Reserved.
Set to zero.
3
OffEn
Offset Enable.
Set high to enable a programmed phase shift between the input
reference and the generated clocks.
2 - 0
C16OCNT10-8
C16 Offset Count.
The three most significant bits of the offset delay word. These
bits program the offset all clocks derived from 16.384 MHz with respect to the input
reference in step sizes of 60 nS.
Table 9 - Set Delay Word 2 (Address 06H - Read/Write)
Bit
Name
Functional Description
7 - 0
C16OCNT 7-0
C16 Offset Count
. The eight least significant bits of the offset delay word. These
bits program the offset of all clocks derived from 16.384 MHz with respect to the
input reference in step sizes of 60 nS.
Table 10 - Set Delay Word 1 (Address 07H - Read/Write)
Bit
Name
Functional Description
7- 0
ID7-0
Identification Word 7-0
. These bits contain the revision number of the part.
Table 11 - Identification Word (Address 0FH - Read Only)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT9040 | T1/E1 Synchronizer |
| MT9040AN | T1/E1 Synchronizer |
| MT9043 | T1/E1 System Synchronizer |
| MT9043AN | T1/E1 System Synchronizer |
| MT9043AN48PINSSOP | T1/E1 System Synchronizer |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT9040AN | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:T1/E1 Synchronizer |
| MT9040AN1 | 制造商:Microsemi Corporation 功能描述:FRAMER E1 /T1 3.3V 48SSOP - Rail/Tube |
| MT9040ANR1 | 制造商:Microsemi Corporation 功能描述:FRAMER E1 /T1 3.3V 48SSOP - Tape and Reel |
| MT9041 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:Multiple Output Trunk PLL |
| MT9041AP | 制造商:Microsemi Corporation 功能描述:WAN/PLL 制造商:Zarlink Semiconductor Inc 功能描述:WAN/PLL |
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