參數(shù)資料
型號： ML610Q412P-XXXWA
廠商： LAPIS SEMICONDUCTOR CO LTD
元件分類： 微控制器/微處理器
英文描述： RISC MICROCONTROLLER, UUC95
封裝： 2.83 MM X 2.63 MM, 0.35 MM HEIGHT, 0.80 MM PITCH, DIE-95
文件頁數(shù)： 122/152頁
文件大?。?/td> 1641K
代理商： ML610Q412P-XXXWA
ML610Q411/ML610Q412/ML610Q415 User’s Manual
Chapter 5
Interrupts (INTs)
5 – 10
5.2.9
Interrupt Request Register 0 (IRQ0)
Address: 0F018H
Access: R/W
Access size: 8 bits
Initial value: 00H
7
6
5
4
3
2
1
0
IRQ0
QNMI
QWDT
R/W
Initial value
0
IRQ0 is a special function register (SFR) to request an interrupt for each interrupt source.
The watchdog timer interrupt (WDTINT) and the NMI interrupt (NMINT) are non-maskable interrupts that do not
depend on MIE.
In this case, an interrupt is requested to the CPU regardless of the value of the Mask Interrupt Enable
flag (MIE).
Each IRQ0 request flag is set to “1” regardless of the MIE value when an interrupt is generated. By setting the IRQ0
request flag to “1” by software, an interrupt can be generated.
The corresponding flag of IRQ0 is set to “0” by hardware when the interrupt request is accepted by the CPU.
[Description of Bits]
QWDT (bit 0)
QWDT is the request flag for the watchdog timer interrupt (WDTINT).
QWDT
Description
0
No request (initial value)
1
Request
QNMI (bit 1)
QNMI is the request flag for the NMI interrupt (NMINT).
QNMI
Description
0
No request (initial value)
1
Request
Note:
When an interrupt is generated by the write instruction to the interrupt request register (IRQ0), the interrupt shift cycle
starts after the next 1 instruction is executed.
相關(guān)PDF資料
PDF描述
ML610Q411-XXXWA RISC MICROCONTROLLER, UUC95
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ML610Q422-NNNTBZ03A RISC MICROCONTROLLER, PQFP120
ML610Q421-XXXWA RISC MICROCONTROLLER, UUC116
ML610Q422P-XXXWA RISC MICROCONTROLLER, UUC116
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參數(shù)描述
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