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參數(shù)資料
| 型號： | ML610Q412P-XXXWA |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | RISC MICROCONTROLLER, UUC95 |
| 封裝： | 2.83 MM X 2.63 MM, 0.35 MM HEIGHT, 0.80 MM PITCH, DIE-95 |
| 文件頁數(shù)： | 103/152頁 |
| 文件大小： | 1641K |
| 代理商： | ML610Q412P-XXXWA |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁當前第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁
ML610Q411/ML610Q412/ML610Q415 User’s Manual
Chapter 4
MCU Control Function
4 – 9
4.2.8
Block Control Register 4(BLKCON4)
Address: 0F02CH
Access: R/W
Access size: 8 bits
Initial value: 00H
7
6
5
4
3
2
1
0
BLKCON4
―
DLCD
DBLD
DXTSP
―
DRAD
DSAD
R/W
Initial value
0
BLKCON4 is a special function register (SFR) to make even more reducing current consumption by turning unused
peripherals off.
[Description of Bits]
DLCD (bit 6)
The DLCD bit is used to control LCD driver operation. When the DLCD bit is set to “1”, the circuits related to LCD
driver are reset and turned off.
DLCD
Description
0
Enable operating LCD driver (initial value)
1
Disable operating LCD driver
DBLD (bit 5)
The DBLD bit is used to control BLD (Battery Level Detector) operation. When the DBLD bit is set to “1”, the
circuits related to BLD are reset and turned off.
DBLD
Description
0
Enable operating BLD (initial value)
1
Disable operating BLD driver
DXTSP (bit 4)
ML610Q411/Q412: The DXTSP bit is used to control 32kHz oscillation stop detect operation. Only during HALT
mode, When the DXTSP bit is set to “1”, the circuits related to 32kHz oscillation stop detect are reset and turned off.
When the operating mode is not in HALT, the 32kHz oscillation stop detect is always working regardless the
condition of this bit.
ML610Q415: The 32kHz oscillation stop detect circuit is always disable regardless the condition of this bit.
DXTSP
Description
0
Enable operating 32kHz oscillation stop detect (initial value)
1
Disable operating 32kHz oscillation stop detect in HALT mode*
* ML610Q411PA has a different specification of that the circuits related to 32kHz oscillation stop detect are reset and
turned off (disabled) when the DXTSP bit is set to “1” regardless the CPU in HALT mode or not.
DRAD (bit 1)
The DRAD bit is used to control RC type A/D converter operation. When the DRAD bit is set to “1”, the circuits
related to RC type A/D converter are reset and turned off.
DRAD
Description
0
Enable operating RC type A/D converter (initial value)
1
Disable operating RC type A/D converter
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