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參數(shù)資料
| 型號： | MCIMX357DVM5BR2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 139/147頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU I.MX35 400MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | i.MX35 |
| 核心處理器： | ARM11 |
| 芯體尺寸： | 32-位 |
| 速度： | 532MHz |
| 連通性： | 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，I²S，LCD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 96 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 128K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.33 V ~ 1.47 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -20°C ~ 70°C |
| 封裝/外殼： | 400-LFBGA |
| 包裝： | 帶卷 (TR) |
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i.MX35 Applications Processors for Industrial and Consumer Products, Rev. 10
Freescale Semiconductor
91
4.9.13.5.10
Serial Interfaces, Electrical Characteristics
Figure 66 depicts timing of the serial interface. Table 59 lists the timing parameters at display access level.
Figure 66. Asynchronous Serial Interface Timing Diagram
Table 59. Asynchronous Serial Interface Timing Parameters—Access Level
ID
Parameter
Symbol
Min.
Typ.1
Max.
Units
IP48 Read system cycle time
Tcycr
Tdicpr – 1.5
Tdicpr2
Tdicpr + 1.5
ns
IP49 Write system cycle time
Tcycw
Tdicpw – 1.5
Tdicpw3
Tdicpw + 1.5
ns
IP50 Read clock low pulse width
Trl
Tdicdr – Tdicur – 1.5
Tdicdr4 –Tdicur5 Tdicdr – Tdicur + 1.5
ns
IP51 Read clock high pulse width
Trh
Tdicpr – Tdicdr + Tdicur
–1.5
Tdicpr – Tdicdr +
Tdicur
Tdicpr – Tdicdr + Tdicur
+1.5
ns
IP52 Write clock low pulse width
Twl
Tdicdw – Tdicuw – 1.5
Tdicdw6 –
Tdicuw7
Tdicdw – Tdicuw + 1.5
ns
IP53 Write clock high pulse width
Twh
Tdicpw – Tdicdw +
Tdicuw – 1.5
Tdicpw – Tdicdw
+Tdicuw
Tdicpw – Tdicdw +
Tdicuw + 1.5
ns
IP54 Controls setup time for read
Tdcsr
Tdicur – 1.5
Tdicur
—
ns
IP49, IP48
Read Data
IP51, IP53
IP58
IP59
DISPB_SER_RS
DISPB_DATA
(Input)
(Output)
IP56,IP54
IP57, IP55
IP50, IP52
IP61
IP60
IP67,IP65
IP47
IP64, IP66
IP62, IP63
DISPB_SD_D_CLK
read point
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