參數(shù)資料
型號(hào)： MC9S12UF32PU
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 60 MHz, MICROCONTROLLER, PQFP100
封裝： LQFP-100
文件頁(yè)數(shù)： 79/128頁(yè)
文件大小： 1785K
代理商： MC9S12UF32PU
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System on a Chip Guide — 9S12UF32DGV1/D V01.05
54
Freescale Semiconductor
2.3 Signal Properties Summary for 64-pin Package
Table 2-4 64-pin Signal Properties
Pin Name
Function
1
Pin Name
Function
2
Pin Name
Function
3
Pin Name
Function
4
Pin Name
Function
5
Supply
Rail
Internal Pull
Resistor
Description
CTRL
Reset
State
EXTAL
—
-
NA
Oscillator pins
XTAL
—
-
NA
TEST1
—
NA
Test pin only
PE7
NOACC
—
CFA10
—
VDDR
PUCR
Up
Port E I/O pin; CPU no access;
CFHC Address.
PE6
IPIPE1
MODB
CFA9
—
VDDR
While RESET is
low: Down
Port E I/O pin; pipe status; mode
selection; CFHC Address.
PE5
IPIPE0
MODA
CFA8
—
VDDR
While RESET is
low: Down
Port E I/O pin; pipe status; mode
selection; CFHC Address.
PE4
ECLK
—
VDDR
PUCR
Up
Port E I/O pin; bus clock output
PE3
LSTRB
TAGLO
CFA3
—
VDDR
PUCR
Up
Port E I/O pin; low strobe; tag
signal low; CFHC Address.
PE2
R/W
—
VDDR
PUCR
Up
Port E I/O pin; R/W in expanded
modes
PE0
XIRQ
—
VDDR
Always up
Port E input; non-maskable
interrupt pin
PA7
ADDR15/
DATA15
CFD15
ATAD15
—
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data.
PA6
ADDR14/
DATA14
CFD14
ATAD14
MSBS
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; MSHC Bus State
signal.
PA5
ADDR13/
DATA13
CFD13
ATAD13
SDDATA3
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; SDHC SDDATA3
signal.
PA4
ADDR12/
DATA12
CFD12
ATAD12
SDDATA2
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; SDHC SDDATA2
signal.
PA3
ADDR11/
DATA11
CFD11
ATAD11
SDDATA1
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; SDHC SDDATA1
signal.
PA2
ADDR10/
DATA10
CFD10
ATAD10
SDDATA0
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; SDHC SDDATA0
signal.
PA1
ADDR9/
DATA9
CFD9
ATAD9
SDCLK
VDDX
PUCR Disabled
Port A I/O pin; multiplexed
address/data; CFHC Data;
ATA5HC Data; SDHC SDCLK
signal.
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PDF描述
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