參數(shù)資料
型號： MC68322FT16
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, 16.667 MHz, RISC PROCESSOR, PQFP160
封裝： PLASTIC, QFP-160
文件頁數(shù)： 199/283頁
文件大?。?/td> 1602K
代理商： MC68322FT16
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Index
MOTOROLA
MC68322 USER’S MANUAL
Index-5
F
fast-page mode, 7-1
features
core, 3-1
MC68322, 1-2
FH (frame height), defined 13-4
flush request
DMA, during operation, 8-6
flush request, DMA 8-3
frame bit map described 12-2
frame bitmap, 12-2
FW (frame width), defined 13-3
G
GDMA (general purpose DMA), (see DMA)
GDMA, 8-2
GDMCR, 8-3
glossary, E-1
graphic operations
bit block and scanline order execution, 12-14
bit block transfer, 12-5
bitmap types, 12-1
Boolean codes, 12-3
graphic operands
types, 12-3
graphic operands, 12-2
location and address constraints, 12-15
scanline and halftone table example, 12-13
scanline transfer
executing during banded applications, 12-9
halftone companion tables, 12-10
run operation, 12-8
scanline transfer, 12-5
graphic operations, 12-1
graphic order
interrupted 11-4
graphic orders
address alignment, 13-5
addresses, 13-5
band number and fault, 13-7
bitBLT during duplex 13-6
defined 11-1
descriptions, 13-8
display list sequence, 13-5
duplex operation 13-6
example display list format 13-5
execution unit, 11-1
operand types, 12-2
parser, 11-1
scanline during duplex, 13-6
types
bit block transfer, 13-3
expanded bit block transfer, 13-3
initialization, 13-1
program flow control, 13-3
scanline transfer, 13-4
types, 13-1
graphic orders, 13-1
graphics unit
shut down 12-15
H
HA (halftone address), defined 13-3
halftone
32-bit specifier, 12-10
48-bit specifier described 12-11
bit map type described 12-2
operand type described 12-2
specifier boundary conditions 12-12
table
address convention 12-15
table address (HTTA) during duplex
operation 13-6
halftone bitmap, 12-2
halftone companion table, 12-10
halftoning
definition, 1-10
handshaking
compatability
error cycles, 9-12
ECP
enabling with RLE, 9-9
enabling without RLE 9-9
operation 9-9
with RLE, 9-10
without RLE, 9-10
hardware, disabling, 9-10
resetting controller, 9-14
software-controlled, 9-11
handshaking modes
compatability
enabling, 9-8
operation 9-8
PDMA during 9-8
ECP
command bytes during, 9-3
types, 9-8
hardware handshaking, 9-7
horizontal margin (see page, margins)
HTTA (see halfton table address)
HXR (halftone X remainder), defined 13-3
HYR (halftone Y remainder), defined 13-4
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
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n
c
..
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PDF描述
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MC68331CFC25B1 32-BIT, 25 MHz, MICROCONTROLLER, PQFP132
MC68331CPV16B1 32-BIT, 16 MHz, MICROCONTROLLER, PQFP144
MC68331CPV20 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP144
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