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參數(shù)資料
| 型號： | MC56F8157 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 16-BIT HYBRID CONTROLLERS |
| 中文描述： | 16位混合控制器 |
| 文件頁數(shù)： | 141/172頁 |
| 文件大小： | 2444K |
| 代理商： | MC56F8157 |
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External Clock Operation Timing
56F8357 Technical Data, Rev. 8.0
Freescale Semiconductor
Preliminary
141
10.5 External Clock Operation Timing
Figure 10-3 External Clock Timing
10.6 Phase Locked Loop Timing
Table 10-13 External Clock Operation Timing Requirements
1
1. Parameters listed are guaranteed by design.
2. See
Figure 10-3
for details on using the recommended connection of an external clock driver.
3. The high or low pulse width must be no smaller than 8.0ns or the chip will not function.
4. External clock input rise time is measured from 10% to 90%.
5. External clock input fall time is measured from 90% to 10%.
Characteristic
Symbol
Min
Typ
Max
Unit
Frequency of operation (external clock driver)
2
f
osc
0
—
120
MHz
Clock Pulse Width
3
t
PW
3.0
—
—
ns
External clock input rise time
4
t
rise
—
—
10
ns
External clock input fall time
5
t
fall
—
—
10
ns
Table 10-14 PLL Timing
Characteristic
Symbol
Min
Typ
Max
Unit
External reference crystal frequency for the PLL
1
1. An externally supplied reference clock should be as free as possible from any phase jitter for the PLL to work
correctly. The PLL is optimized for 8MHz input crystal.
2. ZCLK may not exceed 60MHz. For additional information on ZCLK and (f
OUT
/2
)
, please refer to the OCCS chapter in
the
56F8300 Peripheral User Manual
.
3. This is the minimum time required after the PLL set up is changed to ensure reliable operation.
f
osc
4
8
8
MHz
PLL output frequency
2
(f
OUT
)
f
op
160
—
260
MHz
PLL stabilization time
3
-40
°
to +125
°
C
t
plls
—
1
10
ms
External
Clock
V
IH
V
IL
Note: The midpoint is V
IL
+ (V
IH
– V
IL
)/2.
90%
50%
10%
90%
50%
10%
t
PW
t
PW
t
fall
t
rise
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PDF描述 |
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參數(shù)描述 |
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| MC56F8157VPYE | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16 BIT HYBRID CONTROLLER RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| MC56F8157VVFE | 功能描述:IC DGTL SIGNAL CTLR 160-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:56F8xxx 標準包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設備:- 輸入/輸出數(shù):32 程序存儲器容量:8KB（8K x 8） 程序存儲器類型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱:864285 |
| MC56F8165 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| MC56F8165E | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
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