參數(shù)資料
型號： MB86295S-PB-GS
廠商： FUJITSU LTD
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA256
封裝： PLASTIC, BGA-256
文件頁數(shù)： 81/310頁
文件大?。?/td> 1530K
代理商： MB86295S-PB-GS
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FUJISTU LIMITED PRELIMINARY AND CONFIDENTIAL
MB86295S <Coral-LP>
163
Specification Manual Rev1.1
BCR (Bus Control Register)
Register address I2C Base Address + 0004h
Bit No
7
6
5
4
3
2
1
0
Bit field name
BER
BEIE
SCC
MSS
ACK
GCAA
INTE
INT
R/W
R/W0
R/W
R0/W1
R/W
Default
0
Bit7
BER (Bus Error)
Flag bit for request of bus error interruption
When this bit is set, EN bit on CCR register will be cleared, this module will be in a stop
state and data transfer will be discontinued.
write case
0: A request of buss error interruption is cleared.
1: Don’t care.
read case
0: A bus error was not detected.
1: Undefined START condition or STOP condition was detected while data transfer.
Bit6
BEIE (Bus Error Interruption Enable)
Permit bus error interruption
When both this bit and BER bit are “1”, the interruption is generated.
0: Prohibition of bus error interruption
1: Permission of bus error interruption
Bit5
SCC (Start Condition Continue)
Generate START condition
write case
0: Don’t care.
1: START condition is generated again at the time of master transmission.
Bit4
MSS (Master Slave Select)
Select master / slave mode
When arbitration lost is generated in master transmission, this bit is cleared and this
module becomes a slave mode.
0: This module becomes a slave mode after generating STOP condition and completing
transfer.
1: This module becomes a master mode, generates START condition and starts transfer.
Bit3
ACK (ACKnowledge)
Permit generation of acknowledge at the time of data reception
This bit becomes invalid at the time of address data reception in a slave mode.
0: Acknowledge is not generated.
1: Acknowledge is generated.
Bit2
GCAA(General Call Address Acknowledge)
Permit generation of acknowledge at the time of general call address reception
0: Acknowledge is not generated.
1: Acknowledge is generated.
Bit1
INTE (INTerrupt Enable)
Permit interruption
When this bit is “1” interruption is generated if INT bit is “1”.
0: Prohibition of interrupt
1: Permission of interrupt
Bit0
INT (INTrrupt)
Flag bit for request of interruption for transfer end
When this bit is “1” SCL line is maintained at “L” level. If this bit is cleared by being
written “0”, SCL line is released and the following byte transfer is started. Moreover, it is
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MB86606PMT SCSI BUS CONTROLLER, PQFP144
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MB86296SPB-GS-JX 制造商:FUJITSU 功能描述:
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