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參數(shù)資料
| 型號： | MACH1 |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | High-Performance EE CMOS Programmable Logic |
| 中文描述： | 高性能電子工程CMOS可編程邏輯 |
| 文件頁數(shù)： | 48/48頁 |
| 文件大?。?/td> | 1136K |
| 代理商： | MACH1 |
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MACH 1 & 2 Families
9
n
From
Logic
Allocator
To Switch
Matrix
To
I/O
Cell
a. Combinatorial, active high
n
From
Logic
Allocator
To Switch
Matrix
To
I/O
Cell
b. Combinatorial, active low
n
To Switch
Matrix
c. D-type register, active high
AP
AR
DQ
n
To Switch
Matrix
d. D-type register, active low
AP
AR
DQ
AP
AR
T
Q
n
To Switch
Matrix
e. T-type register, active high
f. T-type register, active low
AP
AR
T
Q
n
To Switch
Matrix
n
To Switch
Matrix
g. Latch, active high (MACH 2 only)
n
To Switch
Matrix
h. Latch, active low (MACH 2 only)
AP
AR
L
Q
G
CLKn
CLK0
CLKn
CLK0
CLKn
CLK0
CLKn
CLK0
CLKn
CLK0
CLKn
CLK0
AP
AR
L
Q
G
Figure 4. Output Macrocell Congurations
From
Logic
Allocator
To
I/O
Cell
From
Logic
Allocator
To
I/O
Cell
From
Logic
Allocator
To
I/O
Cell
From
Logic
Allocator
To
I/O
Cell
From
Logic
Allocator
To
I/O
Cell
From
Logic
Allocator
To
I/O
Cell
14051K-005
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MACH210A-10JC | High-Density EE CMOS Programmable Logic |
| MACH210A-10VC | High-Density EE CMOS Programmable Logic |
| MACH210A-12JC | High-Density EE CMOS Programmable Logic |
| MACH210A-12VC | High-Density EE CMOS Programmable Logic |
| MACH210A-7 | High-Density EE CMOS Programmable Logic |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MACH10015JC | 制造商:AMD 功能描述:NEW |
| MACH102-24TP-F | 制造商:HIRSCHMANN INDUSTRIAL 功能描述:ETHERNET SWITCH, 19 IN. RACK MOUNT, 24 PORTS 10/100BASETX, 2 GIG COMBO PORTS |
| MACH102-24TP-FR | 制造商:HIRSCHMANN INDUSTRIAL 功能描述:ETHERNET SWITCH, 19 IN. RACK MOUNT SWITCH, 24 PORTS 10/100BASETX, 2 COMBO PORTS |
| MACH102-8TP | 制造商:HIRSCHMANN INDUSTRIAL 功能描述:ETHERNET SWITCH, 19 IN. RACK MOUNT, 8 PORTS 10/100BASETX, 2 COMBO PORTS |
| MACH102-8TP-F | 制造商:HIRSCHMANN INDUSTRIAL 功能描述:ETHERNET SWITCH, 19 IN. RACK MOUNT, 8 PORTS 10/100BASETX, 2 GIG COMBO PORTS |
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