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參數(shù)資料
| 型號： | MACH1 |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | High-Performance EE CMOS Programmable Logic |
| 中文描述： | 高性能電子工程CMOS可編程邏輯 |
| 文件頁數(shù)： | 27/48頁 |
| 文件大?。?/td> | 1136K |
| 代理商： | MACH1 |
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MACH 1 & 2 Families
33
ICC vs. FREQUENCY
These curves represent the typical power consumption for a particular device at system frequency.
The selected “typical” pattern is a 16-bit up-down counter. This pattern lls the device and
exercises every macrocell. Maximum frequency shown uses internal feedback and a D-type
register.
TA = 25°C, VCC =5V
0
10
20
30
40
50
60
70
80
90
100 110 120 130 140 150
High Speed
Low Power
Frequency (MHz)
I CC
(mA)
0
25
50
75
100
125
150
0
10
20
30405060708090
High Speed
Low Power
Frequency (MHz)
I CC
(mA)
0
50
25
100
75
125
150
175
200
225
250
0
10
20
30
40
50
60
70
80
90
100 110 120 130 140 150
Low Power
Frequency (MHz)
I CC
(mA)
0
25
50
75
100
125
150
High Speed
MACH111(SP)
MACH131(SP)
MACH211(SP)
0
10
20
30405060708090
High Speed
Low Power
Frequency (MHz)
I CC
(mA)
0
50
25
100
75
125
150
175
200
225
250
MACH 221(SP)
275
Low Power
Frequency (MHz)
100
150
200
250
300
350
400
High Speed
MACH231
Low Power
Frequency (MHz)
50
100
150
200
250
300
350
High Speed
MACH231SP
400
0
10
20
304050607080
0
10
20
304050607080
I CC
(mA)
I CC
(mA)
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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