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參數(shù)資料
| 型號： | M44C090-XXX-DIT |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 4 MHz, MICROCONTROLLER, UUC |
| 封裝： | CHIP |
| 文件頁數(shù)： | 45/319頁 |
| 文件大?。?/td> | 11009K |
| 代理商： | M44C090-XXX-DIT |
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139
Atmel ATmega16/32/64/M1/C1 [DATASHEET]
7647K–AVR–12/13
Bits 1, 0 – SPR1, SPR0: SPI Clock Rate Select 1 and 0
These two bits control the SCK rate of the device configured as a Master. SPR1 and SPR0 have no effect on the slave. The
relationship between SCK and the clkIO frequency fclkio is shown in the following table:
15.2.5 SPI Status Register – SPSR
Bit 7 – SPIF: SPI Interrupt Flag
When a serial transfer is complete, the SPIF flag is set. An interrupt is generated if SPIE in SPCR is set and global interrupts are
enabled. If SS is an input and is driven low when the SPI is in master mode, this will also set the SPIF flag. SPIF is cleared by
hardware when executing the corresponding interrupt handling vector. Alternatively, the SPIF bit is cleared by first reading the
SPI status register with SPIF set, then accessing the SPI data register (SPDR).
Bit 6 – WCOL: Write COLlision Flag
The WCOL bit is set if the SPI data register (SPDR) is written during a data transfer. The WCOL bit (and the SPIF bit) are
cleared by first reading the SPI status register with WCOL set, and then accessing the SPI data register.
Bit 5..1 – Res: Reserved Bits
These bits are reserved bits in the ATmega16/32/64/M1/C1 and will always read as zero.
Bit 0 – SPI2X: Double SPI Speed Bit
When this bit is written logic one the SPI speed (SCK Frequency) will be doubled when the SPI is in master mode (see
Table 15-4). This means that the minimum SCK period will be two CPU clock periods. When the SPI is configured as slave, the
SPI is only guaranteed to work at fclkio/4 or lower.
The SPI interface on the ATmega16/32/64/M1/C1 is also used for program memory and EEPROM downloading or uploading.
See Section 25.9.1 “Serial Programming Algorithm” on page 270 for serial programming and verification.
15.2.6 SPI Data Register – SPDR
Bits 7:0 - SPD7:0: SPI Data
The SPI data register is a read/write register used for data transfer between the register file and the SPI shift register. Writing to
the register initiates data transmission. Reading the register causes the shift register receive buffer to be read.
Table 15-4. Relationship Between SCK and the Oscillator Frequency
SPI2X
SPR1
SPR0
SCK Frequency
0
fclkio/4
0
1
f
clkio/16
0
1
0
f
clkio/64
0
1
fclkio/128
1
0
f
clkio/2
1
0
1
f
clkio/8
1
0
fclkio/32
1
f
clkio/64
Bit
765
432
10
SPIF
WCOL
–
SPI2X
SPSR
Read/Write
R
R/W
Initial Value
000
00
Bit
7654321
0
SPD7
SPD6
SPD5
SPD4
SPD3
SPD2
SPD1
SPD0
SPDR
Read/Write
R/W
Initial Value
XXX
XXXXX
Undefined
相關PDF資料 |
PDF描述 |
|---|---|
| M48ST59W-70MH1TR | 0 TIMER(S), REAL TIME CLOCK, PDSO44 |
| M48ST59W-100MH1 | 0 TIMER(S), REAL TIME CLOCK, PDSO44 |
| M48T02-150PC1 | 0 TIMER(S), REAL TIME CLOCK, PDIP24 |
| M48T18-100MH1TR | 0 TIMER(S), REAL TIME CLOCK, PDSO28 |
| M48T18-100MH1 | 0 TIMER(S), REAL TIME CLOCK, PDSO28 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| M44C890 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-Current Microcontroller for Wireless Communication |
| M44C890-H | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-Current Microcontroller for Wireless Communication |
| M44S05K4F1 | 功能描述:汽車連接器 MX44 Terminals RoHS:否 制造商:Amphenol SINE Systems 產(chǎn)品:Contacts 系列:ATP 位置數(shù)量: 型式:Female 安裝風格: 端接類型: 觸點電鍍:Nickel |
| M44T332538880MHZ | 制造商:MEC 功能描述: |
| M44T3338880MHZ | 制造商:MEC 功能描述: |
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