參數(shù)資料
型號(hào)： M38869MCA-XXXGP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 5 MHz, MICROCONTROLLER, PQFP80
封裝： 0.65 MM PITCH, PLASTIC, QFP-80!
文件頁(yè)數(shù)： 123/380頁(yè)
文件大?。?/td> 4158K
代理商： M38869MCA-XXXGP
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2-92
3886 Group User’s Manual
APPLICATION
2.5 Multi-master I2C-BUS interface
Generating of RESTART condition; Transmission of slave address + read bit
Confirm correct completion of communication at before generating the RESTART condition.
After confirming correct completion, generate the RESTART condition and perform the transmission
process of “slave address + read bit”. Note that procedure because that is different from ’s
process.
As the same reason as , write “slave address + read bit” to the I2C data shift register (address
001216) before performing to make the START condition generate. However, when writing a slave
address to the I2C data shift register in this condition, a slave address is output at that time.
Consequently, the RESTART condition cannot be generated. Therefore, follow the slave reception
procedure before those processes.
In case the arbitration lost detecting flag (AL bit, bit 3 of address 001416) is “1”, return to the
process , because other master devices will have priority to communicate.
When the last received bit (LRB bit; bit 0 of address 001416) is “1”, generate the STOP condition
and make the bus release, because acknowledgment cannot be done owing to BUSY status of the
slave device specified on the I2C-BUS or other reasons.
Fig. 2.5.21 Transmission process of RESTART condition and slave address + read bit
AL (address 1416), bit 3 ?
0(not detected)
0(ACK)
S1(address 1416)
← 000000002 (Note 1)
LRB (address 1416), bit 0 ?
1(NACK)
(A)
← 000101112
S0(address 001216)
← (A)
S1(address 001416)
← 111100002
SEI (Note 2)
End
Stop condition output
Re-transmission preparation
0(command transmission)
PIN (address 1416), bit 4 ?
3
CLI(Note 2)
Slave address value write
Bus judgment during hold
Judgment of arbitration lost detection
ACK confirmation
Slave receive mode set
Slave address read out
Interrupt disabled
Interrupt enabled
RESTART condition occurrence
1 (stop condition)
1 (detected)
Notes 1: Set to the receive mode while the PIN bit is “0”. Do not write “1” to the PIN bit.
2: In this example, the SEI instruction to disable interrupts need not be executed because this
processing is going to be performed in the interrupt processing. When the start condition is
generated out of the interrupt processing, execute the SEI instruction to disable interrupts.
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PDF描述
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